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參數(shù)資料
| 型號(hào)： | MT47H128M8HQ-187ELAT:E |
| 元件分類： | DRAM |
| 英文描述： | 128M X 8 DDR DRAM, 0.35 ns, PBGA60 |
| 封裝： | 8 X 11.50 MM, ROHS COMPLIANT, FBGA-60 |
| 文件頁(yè)數(shù)： | 125/133頁(yè) |
| 文件大?。?/td> | 9170K |
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Figure 44: Multibank Activate Restriction
Command
Don’t Care
T1
T0
T2
T3
T4
T5
T6
T7
tRRD (MIN)
Row
READ
ACT
NOP
tFAW (MIN)
Bank address
CK#
Address
CK
T8
T9
Col
Bank a
ACT
READ
ACT
NOP
Row
Col
Row
Col
Bank c
Bank b
Bank d
Bank c
Bank e
ACT
Row
T10
Bank d
Bank b
Bank a
Note: 1. DDR2-533 (-37E, x4 or x8), tCK = 3.75ns, BL = 4, AL = 3, CL = 4, tRRD (MIN) = 7.5ns,
tFAW (MIN) = 37.5ns.
1Gb: x4, x8, x16 DDR2 SDRAM
ACTIVATE
PDF: 09005aef821ae8bf
1GbDDR2.pdf – Rev. S 10/09 EN
91
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