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參數(shù)資料
| 型號： | MT90520 |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| 中文描述： | 8端口基本速率電路仿真AAL1特區(qū) |
| 文件頁數(shù)： | 63/180頁 |
| 文件大?。?/td> | 1736K |
| 代理商： | MT90520 |
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MT90520
Data Sheet
63
Zarlink Semiconductor Inc.
.
Figure 24 - Overview of CBR Data Segmentation Process (SDT Mode)
4.5.4 Data TX_SAR Module
The TX_SAR (and specifically the sub-module which shall henceforth be called the Data TX_SAR) is capable of
transmitting non-CBR data cells which are not associated with any TDM port. These cells may be AAL5 signalling
cells, OAM-type data cells, or any other ATM cells which need to be transmitted from a system containing an
MT90520 device.
The Data TX_SAR does not process or manipulate the data cells. Rather, it simply reads cells which have been
written to a multi-cell circular buffer in external memory by a CPU. It then transfers those cells to the UTOPIA
module for transmission onto the UTOPIA bus.
The Data TX_SAR can operate simultaneously with the generation of AAL1 CBR cells by the TX_SAR.
4.5.4.1 Mode of Operation
The Data TX_SAR within the MT90520 must be enabled, by setting the
Data TX_SAR Enable
bit in the Data
TX_SAR Control Register at address 103Eh.
The user writes the cells to a buffer located in external memory. The address and size of this buffer are
programmed in the DTCON register, located at address 1038h. The cell structure format is illustrated in Figure 25.
When the Data TX_SAR is enabled, it begins to send cells from the cell buffer beginning with the cell pointed to by
the Data TX_SAR Read Pointer. The Read Pointer is incremented after each cell is sent. Cell transmission halts
when the Read Pointer is equal to the user-defined Data TX_SAR Write Pointer, which indicates the cell structure
number being written to by the CPU. Cell transmission begins again after the Write Pointer is changed to a different
value than the Read Pointer. The cell buffer is circular; the Read Pointer will never point above the top of the buffer.
TDM
Input
Buffer
DSTi
CSTi
STiCLK
STiMF
TDM Interface
Module (one per
port)
TX_SAR
UTO_OUT_CLK
UTO_OUT_ENBATM_CLAVPHY
UTO_OUT_CLAVATM_ENBPHY
UTO_OUT_SOC
UTO_OUT_DATA[15:0]
UTO_OUT_PAR
TX
UTOPIA
FIFO
UTOPIA Module
SDT Segmentation
Control Structure
(one per VC in
internal memory)
MT90520
External
ZBT
SRAM
SDT Segmentation
Circular Buffers (one
per TDM channel)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT90520AG | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT9072 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT9072AB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT9072AV | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT90820 | Large Digital Switch |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT90520AG | 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays |
| MT90520AG2 | 制造商:Microsemi Corporation 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:ATM SAR 2.048MBPS 2.5V CBR 456BGA - Trays |
| MT90528 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90528AG | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
| MT90528AG2 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:28-Port Primary Rate Circuit Emulation AAL1 SAR |
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