參數(shù)資料
型號： ORSO42G5-2BM484I
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 112/153頁
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描述： IC FPSC TRANSCEIVER 4CH 484-BGA
產(chǎn)品變化通告： Product Discontinuation 01/Aug/2011
標(biāo)準(zhǔn)包裝： 60
系列： *
Lattice Semiconductor
ORCA ORSO42G5 and ORSO82G5 Data Sheet
61
Table 11. TX FPGA/Core Interface Signaling – ORSO42G5
Signal Description for TX Path (FPGA to SERDES Core) – ORSO82G5
Signals are divided across 8 channels with 40 signals per channel. TXDxx[39:0] is the set of 40 signals for a
channel xx.
The data signals multiplexing scheme is similar to the one used for the RXD signals. However, the status signals
multiplexing is different. Please refer to Table 12 for the detailed description of the TXD multiplexing scheme.
For all channels the TXDxx[39:33] signals are not used.
Table 12 summarizes the signals at the FPGA/Core interface in the transmit direction.
TXDAC
SONET Mode
OPC2 A2 Mode
[39:33]
—
32
DINAC_FP
—
[31:21]
DINAC[31:21]
—
20
DINAC[20]
OPC2_A2_CELLVALID
[19:0]
DINAC[19:0]
OPC2_A2[39:20]
TXDAD
SONET Mode
OPC2 A2 Mode
[39:33]
—
32
DINAD_FP
—
[31:21]
DINAD[31:21]
—
20
DINAD[20]
—
[19:0]
DINAD[19:0]
OPC2_A2[19:0]
Table 12. TX FPGA/Core Interface Signaling – ORSO82G5
TXDAA
SONET Mode
OPC2 A1 Mode
OPC8 Mode
[39:33]
—
32
DINAA_FP
—
[31:21]
DINAA[31:21]
—
20
DINAA[20]
OPC2_A1_CELLVALID
—
[19:0]
DINAA[19:0]
OPC2_A1[39:20]
OPC8[159:140]
TXDAB
SONET Mode
OPC2 A1 Mode
OPC8 Mode
[39:33]
—
32
DINAB_FP
—
[31:20]
DINAB[31:20]
—
[19:0]
DINAB[19:0]]
OPC2_A1[19:0]]
OPC8[139:120]]
TXDAC
SONET Mode
OPC2 A2 Mode
OPC8 Mode
[39:33]
—
32
DINAC_FP
—
[31:21]
DINAC[31:21]
—
20
DINAC[20]
OPC2_A2_CELLVALID
—
[19:0]
DINAC[19:0]
OPC2_A2[39:20]
OPC8[119:100]
TXDAD
SONET Mode
OPC2 A2 Mode
OPC8 Mode
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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