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參數(shù)資料
| 型號： | 80376 |
| 廠商： | Intel Corp. |
| 英文描述： | 32-BIT Embedded Microprocessor(32位嵌入式微處理器) |
| 中文描述： | 32位嵌入式微處理器（32位嵌入式微處理器） |
| 文件頁數(shù)： | 62/95頁 |
| 文件大?。?/td> | 1086K |
| 代理商： | 80376 |
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376 EMBEDDED PROCESSOR
The A.C. specifications given in Table 6.4 consist of
output delays, input setup requirements and input
hold requirements. All A.C. specifications are rela-
tive to the CLK2 rising edge crossing the 2.0V level.
A.C. specification measurement is defined by Figure
6.1. Inputs must be driven to the voltage levels indi-
cated by Figure 6.1 when A.C. specifications are
measured. 80376 output delays are specified with
minimum and maximum limits measured as shown.
The minimum 80376 delay times are hold times pro-
vided to external circuitry. 80376 input setup and
hold times are specified as minimums, defining the
smallest acceptable sampling window. Within the
sampling window, a synchronous input signal must
be stable for correct 80376 processor operation.
Outputs NA, W/R, D/C, M/IO, LOCK, BHE, BLE,
A
23
–A
1
and HLDA only change at the beginning of
phase one. D
15
–D
0
(write cycles) only change at the
beginning of phase two. The READY, HOLD, BUSY,
ERROR, PEREQ and D
15
–D
0
(read cycles) inputs
are sampled at the beginning of phase one. The NA,
INTR and NMI inputs are sampled at the beginning
of phase two.
240182–35
LEGEND:
ADMaximum Output Delay Spec.
BDMinimum Output Delay Spec.
CDMinimum Input Setup Spec.
DDMinimum Input Hold Spec.
Figure 6.1. Drive Levels and Measurement Points for A.C. Specifications
62
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