CONDITIONS" />
參數(shù)資料
型號： AD9547BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 10/104頁
文件大小： 0K
描述： IC CLOCK GEN/SYNCHRONIZR 64LFCSP
產(chǎn)品變化通告： AD9547 Mask Change 20/Oct/2010
標準包裝： 1
類型： 時鐘/頻率發(fā)生器，同步器
PLL： 是
主要目的： 以太網(wǎng)，SONET/SDH，Stratum
輸入： CMOS，LVDS，LVPECL
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 750kHz
電源電壓： 1.71 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 托盤
Data Sheet
AD9547
Rev. E | Page 13 of 104
JITTER GENERATION
Table 19.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
CONDITIONS: fREF = 8 kHz1, fDDS = 155.52 MHz2,
fLOOP = 100 Hz3
fSYSCLK = 50 MHz4 crystal; fS = 1 GHz5;
Q-divider = 1; defaultSYSCLK PLL charge
pump current; results valid for LVPECL,
LVDS, and CMOS output logic types
Bandwidth: 100 Hz to 77 MHz
0.71
ps rms
Random jitter
Bandwidth: 5 kHz to 20 MHz
0.34
ps rms
Random jitter
Bandwidth: 20 kHz to 80 MHz
0.43
ps rms
Random jitter
Bandwidth: 50 kHz to 80 MHz
0.43
ps rms
Random jitter
Bandwidth: 4 MHz to 80 MHz
0.31
ps rms
Random jitter
CONDITIONS: fREF = 19.44 MHz1, fDDS = 155.52 MHz2,
fLOOP = 1 kHz3
fSYSCLK = 50 MHz4 crystal; fS = 1 GHz5;
Q-divider = 1; defaultSYSCLK PLL charge
pump current; results valid for LVPECL,
LVDS, and CMOS output logic types
Bandwidth: 100 Hz to 77 MHz
1.05
ps rms
Random jitter
Bandwidth: 5 kHz to 20 MHz
0.34
ps rms
Random jitter
Bandwidth: 20 kHz to 80 MHz
0.43
ps rms
Random jitter
Bandwidth: 50 kHz to 80 MHz
0.43
ps rms
Random jitter
Bandwidth: 4 MHz to 80 MHz
0.32
ps rms
Random jitter
CONDITIONS: fREF = 19.44 MHz1, fDDS = 311.04 MHz2,
fLOOP = 1 kHz3
fSYSCLK = 50 MHz4 crystal; fS = 1 GHz5;
Q-divider = 1; defaultSYSCLK PLL charge
pump current; results valid for LVPECL,
LVDS, and CMOS output logic types
Bandwidth: 100 Hz to 100 MHz
0.67
ps rms
Random jitter
Bandwidth: 5 kHz to 20 MHz
0.31
ps rms
Random jitter
Bandwidth: 20 kHz to 80 MHz
0.33
ps rms
Random jitter
Bandwidth: 50 kHz to 80 MHz
0.33
ps rms
Random jitter
Bandwidth: 4 MHz to 80 MHz
0.16
ps rms
Random jitter
1
fREF is the frequency of the active reference.
2
fDDS is the output frequency of the DDS.
3
fLOOP is the DPLL digital loop filter bandwidth.
4
fSYSCLK is the frequencyat the SYSCLKP and SYSCLKN pins.
5
fS is the sample rate of the output DAC.
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PDF描述
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參數(shù)描述
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AD9548 制造商:AD 制造商全稱:Analog Devices 功能描述:Quad/Octal Input Network Clock Generator/Synchronizer
AD9548/PCBZ 功能描述:BOARD EVAL FOR AD9548 RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評估演示板和套件 系列:- 標準包裝:1 系列:PSoC® 主要目的:電源管理，熱管理 嵌入式:- 已用 IC / 零件:- 主要屬性:- 次要屬性:- 已供物品:板，CD，電源
AD9548/PCBZ 制造商:Analog Devices 功能描述:Clock Generator Evaluation Board
AD9548BCPZ 功能描述:IC CLOCK GEN/SYNCHRONIZR 88LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標準包裝:1 系列:- 類型:時鐘/頻率發(fā)生器，多路復(fù)用器 PLL:是 主要目的:存儲器，RDRAM 輸入:晶體 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:1:2 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:Digi-Reel® 其它名稱:296-6719-6
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