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參數(shù)資料
| 型號(hào)： | MC68322FT16 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 16.667 MHz, RISC PROCESSOR, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 3/283頁 |
| 文件大?。?/td> | 1602K |
| 代理商： | MC68322FT16 |
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MOTOROLA
MC68322 USER’S MANUAL
9-1
SECTION 9
PARALLEL PORT INTERFACE
The MC68322 contains a direct-connect, fully IEEE 1284 Level 2 compliant, bidirectional
parallel port interface (PPI). The PPI supports four IEEE 1284 communications modes—
compatibility (Centronics), nibble, byte, and enhanced capabilities port (ECP). It also
supports all variants of these modes, including device ID requests and run-length encoded
(RLE) data compression.
The PPI contains specific hardware to support automatic handshaking during host to
peripheral (forward) data transfers in compatibility and ECP modes, and run-length
detection and decompression of host to peripheral data during ECP transfers. This can
substantially improve data rates when operating the parallel port in compatibility or ECP
mode. When hardware handshaking is used in combination with the PPI’s dedicated DMA
controller, data rates as high as 2M per second can be achieved in ECP forward mode. The
software can disable and enable hardware handshaking to allow direct control of PPI signals
as well as to support future protocols. The remainder of IEEE 1284 operations (negotiation,
reverse data transfers, and termination cycles) must be carried out by the software. Please
note that IEEE 1284 EPP communications mode is not supported.
The PPI contains an interface controller that consists of a data receive and transmit latch,
run-length encoding decompression logic, input conditioning logic, and edge detector logic.
The RLE decompression is accomplished through a smart state machine and additional
control logic. The PPI has input conditioning logic to filter the incoming control signals.
Figure 9-1 illustrates the PPI controller block diagram.
Figure 9-1. Parallel Port Interface Controller Block Diagram
PD7–PD0
DIGITAL
FILTER/
EDGE
DETECTION
BUSY
ACK
PARALLEL PORT
DATA BUS
STATE
MACHINE
CONTROL
REGISTERS
CONTROL
REGISTERS
DATA
RECEIVE
LATCH
RLE
DECOMPRESSION
LOGIC
DATA
TRANSMIT
LATCH
SELECTIN
STROBE
AUTOFD
INIT
FAULT
SELECT
PERROR
F
re
e
sc
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S
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
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相關(guān)PDF資料 |
PDF描述 |
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