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參數(shù)資料
| 型號： | MC72000 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Integrated Bluetooth Radio |
| 中文描述： | 集成藍(lán)牙無線 |
| 文件頁數(shù)： | 119/156頁 |
| 文件大小： | 1782K |
| 代理商： | MC72000 |
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MOTOROLA
MC72000
Advance Information Data Sheet
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119
7.4.7 Resets
7.4.7.1 General
The SSI is affected by power-on reset and SSI reset.
Power-on reset is generated by asserting either the RESET pin or the computer operating properly (COP)
timer reset. The power-on reset initializes all control registers, which clears the SSIEN bit in SCR2 and
disables the SSI.
The SSI reset is generated when the SSIEN bit in the SCR2 is cleared. The SSI status bits are preset to the
same state produced by the power-on reset. The SSI control bits are unaffected. The control bits in the top
half of the SCSR are also unaffected. The SSI reset is useful for selective reset of the SSI without changing
the present SSI control bits and without affecting the other peripherals.
The correct sequence to initialize the SSI is as follows:
1. Issue a power-on or SSI reset.
2. Program the SSI control registers.
3. Set the SSIEN bit in SCR2.
To ensure proper operation of the SSI, the programmer should use the power-on or SSI reset before
changing any of the following control bits listed in Table 60.
NOTE:
These control bits should not be changed during SSI operation.
NOTE:
The SSI bit clock must go low for at least one complete period to ensure
proper SSI reset.
7.4.8 Clocks
The SSI uses the following three clocks (as shown in Figure 79 and Figure 80):
Table 60. SSI Control Bits Requiring Reset before Change
Control Register
Bit
SRXCR
STXCR
PSR
WL[1:0]
DC[4:0]
PM[7:0]
TEFS
TFSL
TFSI
NET
TSCKP
TSHFD
SYN
REFS
RFSL
RFSI
RSCKP
RSHFD
DIV4DIS
SCR2
SCSR
F
Freescale Semiconductor, Inc.
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n
.
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