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參數(shù)資料
| 型號： | MPC8240 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 102/546頁 |
| 文件大?。?/td> | 5994K |
| 代理商： | MPC8240 |
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3-4
MPC8240 Integrated Processor User's Manual
MOTOROLA
Signal Overview
3.1.1 Signal Cross Reference
The following sections are intended to provide a quick summary of signal functions. Table
3-1 provides an alphabetical cross-reference to the signals of the MPC8240. It details the
signal name, interface, alternate functions, number of signals, whether the signal is an
input, output, or bidirectional, and Tnally a pointer to the section in this chapter where the
signal is described.
Table 3-1. MPC8240 Signal Cross Reference
Signal
Signal Name
Interface
Alternate
Function(s)
Pins
I/O
Section #
AD[31D0]
Address/data
PCI
32
I/O
3.2.1.1
AR[19D12]
ROM address 19D12
Memory
PAR[0D7]
8
O
3.2.2.12
AS
1
Address strobe
Memory
1
O
3.2.2.19
CAS[0D7]
Column address strobe
0D7
Memory
DQM[0D7]
8
O
3.2.2.2
C/BE[3D0]
Command/byte enable
PCI
4
I/O
3.2.1.2
CHKSTOP_IN
Checkstop in
System Control
1
I
3.2.5.6
CKE
1
SDRAM clock enable
Memory
1
O
3.2.2.13
CKO
Debug clock
Clock
DA14
1
O
3.2.7.8
CS[0D7]
SDRAM chip select
Memory
RAS[0D7]
8
O
3.2.2.3
DA[15D11], DA2
Debug addr [15D11, 2]
Debug
6
O
3.2.5.9.3
DA[10D6]
Debug addr [10D6]
Debug
PLL_CFG[0D4]
5
O
3.2.5.9.3
DA5
DA4
DA3
DA1
DA0
Debug addr 5
Debug addr 4
Debug addr 3
Debug addr 1
Debug addr 0
Debug
GNT4
REQ4
PCI_CLK4
CKO
QACK
5
O
3.2.5.9.3
DEVSEL
Device select
PCI
1
I/O
3.2.1.3
DH[0D31]
Data bus high
Memory
32
I/O
3.2.2.10
DL[0D31]
DL[0]
Data bus low
Memory
32
I/O
3.2.2.10
DQM[0D7]
SDRAM data qualiTer
Memory
CAS[0D7]
8
O
3.2.2.4
FOE
1
Flash output enable
Memory
1
O
3.2.2.18
FRAME
Frame
PCI
1
I/O
3.2.1.4
GNT[4D0]
GNT4/DA5
1
PCI bus grant
PCI
GNT0:PCI bus
request
GNT4: DA5
5
O
3.2.1.5
HRST_CPU
Hard reset (processor)
System Control
1
I
3.2.5.1.1
HRST_CTRL
Hard reset (peripheral
logic)
System Control
1
I
3.2.5.1.2
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