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參數(shù)資料
| 型號(hào)： | MPC8240 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 243/546頁 |
| 文件大?。?/td> | 5994K |
| 代理商： | MPC8240 |
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MOTOROLA
Chapter 6. MPC8240 Memory Interface
6-35
SDRAM Interface Operation
6.4.1 Supported SDRAM Organizations
It is not necessary to use identical memory chips in each memory bank; individual memory
banks may be of differing size. Although the MPC8240 multiplexes the row address,
column address, and logical bank select bits onto a shared 14-bit memory address bus,
individual SDRAM banks may be implemented with memory devices requiring fewer than
28 address bits. The MPC8240 can be conTgured to provide 12, or 11 row bits to a
particular bank, and 10, 9, 8, or 7 column bits, and 2 or 4 logical banks. Table 6-14
summarizes the SDRAM memory conTgurations supported by the MPC8240.
Note
The largest DRAM that can be supported is limited to 24 total
address bits.
System software must conTgure the MPC8240, using a memory polling algorithm at
system start-up, to map correctly the size of each bank in memory. Then, the MPC8240 uses
its bank map to assert the appropriate CS[0D7] signal for memory accesses according to the
provided bank depths. System software must also conTgure the MPC8240 at system
start-up to multiplex appropriately the row and column address bits for each bank. Refer to
row-address conTguration in the MCCR1. Address multiplexing occurs according to these
conTguration bits.
Note
Any unused banks should have their starting and ending
addresses programmed out of the range of memory banks in
use.
If a disabled bank has its starting and ending address deTned as overlapping an enabled
banks address space, there may be system memory corruption in the overlapping address
range. Always map unused memory banks starting and ending addresses to memory space
that is not used by the system.
Table 6-13 shows the unsupported multiplexed row and column address bits for 32- and
64-bit modes. ConTgurations using 7 or 8 column address bits in 32-bit data bus mode and
7 column bits in 64-bit data bus mode are not supported as they would create
non-contiguous address spaces.
Table 6-13. Unsupported Multiplexed Row and Column Address Bits
32-bit Data Bus Mode
64-bit Data Bus Mode
14x8
D
13x8
D
12x8
D
12x7
12x7
14x7
14x7
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC8260ACZU | MPC826xA (HiP4) Family Hardware Specifications |
| MPC8260CZU | MPC826xA (HiP4) Family Hardware Specifications |
| MPC8264ACZU | MPC826xA (HiP4) Family Hardware Specifications |
| MPC8264AZU | MPC826xA (HiP4) Family Hardware Specifications |
| MPC8264CZU | MPC826xA (HiP4) Family Hardware Specifications |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC8240EC | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications |
| MPC8241 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Intergrated Processor Hardware Specifications |
| MPC8241EC | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8241 Integrated Processor Hardware Specifications |
| MPC8241LVR166D | 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MPC8241LVR200D | 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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