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參數(shù)資料
| 型號(hào)： | PSD813FH |
| 英文描述： | Field Programmble Microcontroller Peripherals With Flash Memory(帶閃存的現(xiàn)場(chǎng)可編程微控制器) |
| 中文描述： | 場(chǎng)可編程微控制器外圍設(shè)備與快閃記憶體（帶閃存的現(xiàn)場(chǎng)可編程微控制器） |
| 文件頁數(shù)： | 54/83頁 |
| 文件大?。?/td> | 369K |
| 代理商： | PSD813FH |
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PSD813FN/FH
Prelimnary
54
PSD813FN/FHAC/DC Parameters – GPLDand ECSPLDTimng
(5 V ± 10% Versions)
GPLDand ECSPLDCombinatorial Timng
(5 V ± 10%)
-15
PT
Aloc
Slew
Rate
Symbol
Parameter
Conditions
Min
Max
Unit
t
PD1
ECSPLD Input Pin to ECSPLD
Combinatorial Output
(Notes 1 & 2)
24
Add 3
ns
GPLD Input Pin/Feedback to GPLD
Combinatorial Output Port C
t
PD2
(Note 2a)
32
Add 2
ns
GPLD Input Pin/Feedback to GPLD
Combinatorial Output Port A or B
t
PD3
(Note 2a)
34
ns
GPLD Input to ECSPLD Output Enable
(Notes 2 & 2a)
29
Add 3
ns
t
EA
GPLD Input to GPLD Output Enable
(Notes 2a & 2b)
32
ns
GPLD Input to ECSPLD Output Disable
(Notes 2 & 2a)
29
Add 3
ns
t
ER
GPLD Input to GPLD Output Disable
(Notes 2a & 2b)
32
ns
t
ARP
GPLD Register Clear or Preset Delay
(Notes 2a & 2b)
33
ns
t
ARPW
GPLD Register Clear or Preset
Pulse Width
(Notes 2a & 2b)
29
ns
t
ARD
GPLD Array Delay
Any Micro
Cell
22
Add 2
ns
NOTES:
1.
ECSPLD Input pins are A(0:15), PGR(0:3), CNTL(0:2), PDN.
ECSPLD Outputs are PA(0:3), PB(0:3), PD(0:2).
2a. GPLD Inputs are A(0:15), PGR(0:3), CNTL(0:2), PA(0:7), PB(0:7), PC(0:7), PD(0:2), ALE, PDN. Add 25ns for propagation delay
from RSTin pin.
2b. GPLD Outputs are PA(4:7), PB(4:7), PC(0:7).
2.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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