參數(shù)資料
型號： PSD813FH
英文描述： Field Programmble Microcontroller Peripherals With Flash Memory(帶閃存的現(xiàn)場可編程微控制器)
中文描述： 場可編程微控制器外圍設(shè)備與快閃記憶體（帶閃存的現(xiàn)場可編程微控制器）
文件頁數(shù)： 55/83頁
文件大?。?/td> 369K
代理商： PSD813FH
Prelimnary
PSD813FN/FH
55
PSD813FN/FHAC/DC Parameters – GPLDand ECSPLDTimng
(5 V ± 10% Versions)
GPLDMicro
Cell Synchronous Clock Mode Timng
(5 V ± 10% )
-15
PT
Aloc
Slew
Rate
Symbol
Parameter
Conditions
Min
Max
Unit
Maximum Frequency External Feedback
1/(t
S
+ t
CO
)
25.00
MHz
Maximum Frequency Internal
Feedback (f
CNT
)
1/(t
S
+ t
CO
–10)
31.25
MHz
f
MAX
Maximum Frequency Pipelined Data
1/(t
CH
+ t
CL
)
35.71
MHz
t
S
Input Setup Time
(Note 2a)
20
Add 2
ns
t
H
Input Hold Time
(Note 2a)
0
ns
t
CH
Clock High Time
Clock Input
15
ns
t
CL
Clock Low Time
Clock Input
15
ns
t
CO
Clock to Output Delay
Clock Input
22
ns
t
ARD
GPLD Array Delay
Any Micro
Cell
22
Add 2
ns
t
MIN
Minimum Clock Period
t
CH
+ t
CL
29
ns
NOTE:
2a. GPLD Inputs are A(0:15), PGR(0:3), CNTL(0:2), PA(0:7), PB(0:7), PC(0:7), PD(0:2), ALE, PDN. Add 25ns for propagation delay
from RSTin pin.
-15
PT
Aloc
Slew
Rate
Symbol
Parameter
Conditions
Min
Max
Unit
Maximum Frequency External Feedback
1/(t
SA
+ t
COA
)
21.74
MHz
Maximum Frequency Internal
Feedback (f
CNTA
)
1/(t
SA
+ t
COA
–10)
27.78
MHz
f
MAXA
Maximum Frequency Pipelined Data
1/(t
CH
+ t
CL
)
35.71
MHz
t
SA
Input Setup Time
(Note 2a)
12
Add 2
ns
t
HA
Input Hold Time
(Note 2a)
12
ns
t
CHA
Clock Input High Time
(Note 2a)
15
ns
t
CLA
Clock Input Low Time
(Note 2a)
15
ns
t
COA
Clock to Output Delay
(Note 2a)
37
ns
t
ARD
GPLD Array Delay
Any Micro
Cell
22
Add 2
ns
t
MINA
Minimum Clock Period
1/f
CNTA
43
ns
GPLDMicro
Cell Asynchronous Clock Mode Timng
(5 V ± 10%)
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PDF描述
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