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參數(shù)資料
| 型號： | 28229-14 |
| 廠商： | MINDSPEED TECHNOLOGIES INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA256 |
| 封裝： | BGA-256 |
| 文件頁數(shù)： | 146/269頁 |
| 文件大?。?/td> | 3376K |
| 代理商： | 28229-14 |
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28229-DSH-001-B
Mindspeed Technologies
1
-9
CX28224/5/9 Data Sheet
Introduction to IMA
1.1.5
Differential Delay
When dealing with multiple facilities, there is no guarantee that the individual links
within a group will take the same physical path between the terminating equipment.
This variation is referred to as Differential Delay. The ATM Forum specification
requires an IMA implementation to absorb a minimum of 25 ms of differential delay
between the links. Each port requires 8 K of memory for every 27.5 ms of delay (at
E1; 8 K provides for 34.375 ms at T1 rates). The CX28229 provides 256K bytes of
on-board memory for the buffering necessary to re-align the links within an IMA
group. This is sufficient to support the 25 ms delay for 32 IMA ports. In addition, an
external memory bus allows this to be expanded to 2 MB, which supports up to 200
ms of delay. Table 1-4 shows the memory requirements for differential delay.
The magnitude of the differential delay can be quite large when dealing with T1/E1
links; whereas DSL links generally follow the same path and have nearly identical
delays.
Table 1-4. Memory Requirements for Differential Delay (in bytes)
Number of ports
E1
27.5 ms
55 ms
110 ms
220 ms
T1
34.375 ms
68.75 ms
137.5 ms
275 ms
1
8 K
16 K
32 K
64 K
2
16 K
32 K
64 K
128 K
4
32 K
64 K
128 K
256 K
8
64 K
128 K
256 K
512 K
16
128 K
256 K
512 K
1024 K
32
256 K
512 K
1024 K
2048 K
GENERAL NOTE:
Shaded areas can be supported by internal memory. Internal memory is disabled when the external bus is used.
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PDF描述 |
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