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參數(shù)資料
| 型號： | GT-48004A |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | Four Port Switched Fast Ethernet Controller(四端口、交換式快速以太網(wǎng)控制器) |
| 中文描述： | 四端口交換式快速以太網(wǎng)控制器（四端口，交換式快速以太網(wǎng)控制器） |
| 文件頁數(shù)： | 92/106頁 |
| 文件大?。?/td> | 953K |
| 代理商： | GT-48004A |
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GT-48004A Four Port Switched Fast Ethernet Controller
N:\Marketing\Docs\Archive\48004A\DATASHEET\Rev 1.0\484ads10.fm
Revision 1.0
86
CPU Buffe r Ba s e Address, Offset: 0x14003 4
Note: When reading the CPU Buffer Base Address Register (0x140034), the address will be read out 1 bit shifted left.
CPU START_OF_PACKET Base Address, Offset: 0x140038
CPU NEW_ADDRESS Base Address, Offset: 0x14003c
CPU Intervention Ba se Address, Offset: 0x14004 8
Device Table, Offset: 0x40
Bi ts
Fi e l d Na m e
Fun cti o n
In iti a l Va l u e
31:15
BaseAdd
Contains a pointer to the CPU buffer area
0x0
14:0
Reserve
Reserved. Must be 0x0 when written.
-
Bi ts
Fi e l d Na m e
Fun cti o n
In iti a l Va l u e
31:8
StBaseAdd
Contains a pointer to the CPU START_OF_PACKET
area.
The area includes 32 entries (2 32-bit words each) for
the GT-48004A’s START_OF_PACKET messages.
-
7:0
Reserve
Reserved. Must be 0x0 when written.
-
Bi ts
Fi e l d Na m e
Fun cti o n
In iti a l Va l u e
31:8
NABaseAdd
Contains a pointer to the CPU NEW_ADDRESS area.
The area includes 32 entries (2 32-bit words each) for
the GT-48004A’s NEW_ADDRESS messages.
0x0
7:0
Reserve
Reserved. Must be 0x0 when written.
-
Bi ts
Fi e l d Na m e
Fun cti o n
In iti a l Va l u e
31:11
IntBaseAdd
Contains a pointer to the CPU BUFFER_REQUEST
area for unicast packets that are marked for interven-
tion. The area includes 256 entries (2 32-bit words
each) for the GT-48004A’s BUFFER_REQUEST mes-
sages.
0x0
10:0
Reserve
Reserved. Must be 0x0 when written.
-
Bi ts
Fi e l d Na m e
Fun cti o n
In iti a l Va l u e
31:0
DevTab
GT-48004A Device Table. Each bit represents a GT-
48004A device in the system.
0xffffffff
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PDF描述 |
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