參數(shù)資料
型號(hào)： PEB2255
廠商： INFINEON TECHNOLOGIES AG
元件分類(lèi)： 通信及網(wǎng)絡(luò)
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁(yè)數(shù)： 150/374頁(yè)
文件大?。?/td> 5064K
代理商： PEB2255
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PEB 2255
FALC-LH V1.3
Functional Description T1/J1
Data Sheet
150
2000-07
5.5.2
Auto Modes
Automatic remote alarm (
Y
ellow Alarm) access
If the receiver has lost its synchronization (FRS0.LFA) a remote alarm (yellow alarm)
can be sent to the distant end automatically, if enabled by bit FMR2.A
X
RA. In
synchronous state the remote alarm bit is removed.
Automatic AIS to system interface
In asynchronous state the synchronizer enforces an AIS to the receive system
interface
automatically.
However,
received
transparently if bit FMR2.DAIS is set.
Automatic clock source switching
In Slave mode (LIM0.MAS
=
0) the DCO-R synchronizes to the recovered route clock.
In case of Loss of Signal LOS the DCO-R switches to Master mode automatically.
Automatic freeze signaling:
U
pdating of the received signaling information is controlled by the freeze signaling
status. Optionally automatic freeze signaling can be disabled by setting bit SIC3.DAF.
data
may
be
switched
through
5.5.3
The FALC
-LH offers five error counters where each of them has a length of 16 bit. They
record code violations, framing bit errors, CRC6 bit errors, errored blocks and PRBS bit
errors. Each of the error counters is buffered.
U
pdating the buffer is done in two modes:
one second accumulation
on demand via handshake with writing to the DEC register
In the one second mode an internal one second timer updates these buffers and reset
the counter to accumulate the error events in the next one second period. The error
counter can not overflow. Error events occurring during reset are not lost.
Error Counter
5.5.4
The FALC
-LH supports the error performance monitoring by detecting the following
alarms or error events in the received data:
framing errors, CRC errors, code violations, loss of frame alignment, loss of signal, alarm
indication signal, receive and transmit slips.
With a programmable interrupt mask register IMR
4
all these alarms or error events can
generate an Errored Second Interrupt (ISR3.ES) if enabled.
Errored Second
5.5.5
Second Timer
Additionally a one second timer interrupt is generated internally to indicate that the
enabled alarm status bits or the error counters have to be checked. The timing is derived
from RCL
K
.
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PDF描述
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PEB22554HTV1.3 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
PEB2255H-V1.1 制造商:Siemens 功能描述:
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