參數資料
型號： PEB2255
廠商： INFINEON TECHNOLOGIES AG
元件分類： 通信及網絡
英文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述： Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁數： 159/374頁
文件大?。?/td> 5064K
代理商： PEB2255
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PEB 2255
FALC-LH V1.3
Operational Description E1
Data Sheet
15
9
2000-07
E1 Initialization
For a correct start up of the Primary Access Interface a set of parameters specific to the
system and hardware environment must be programmed after reset goes inactive. Both
the basic and the operational parameters must be programmed
before
the activation
procedure of the PCM line starts. Such procedures are specified in IT
U
-T and ETSI
recommendations (e.g. fault conditions and consequent actions). Setting optional
parameters primarily makes sense when basic operation via the PCM line is guaranteed.
Table 40
gives an overview of the most important parameters in terms of signals and
control bits which are to be programmed in one of the above steps. The sequence is
recommended but not mandatory. Accordingly, parameters for the basic and operational
LOOP
X
SW
X
SP
TSWM
X
C0
X
C1
RC0
00
H
4
0
H
00
H
00
H
00
H
9
C
H
00
H
Channel loop back and single frame mode are disabled.
All bits of the transmitted service word are cleared (bit 2
excluded). Spare bit values are cleared.
No transparent mode active.
The transmit clock offset is cleared.
The transmit time slot offset is cleared.
The receive clock slot offset is cleared
;
1st channel phase
is active on PCM highway.
The receive time slot offset is cleared.
Idle channel code is cleared.
Normal operation (no ‘Idle Channel’ selected).
Slave Mode, Local Loop off, CL
KX=
2.0
48
MHz active high,
short haul mode, no LOS indication on RCL
K
Analog interface selected, Remote Loop off
Pulse Count for LOS Detection cleared
Pulse Count for LOS Recovery cleared
Transmit Pulse Mask
All interrupts are disabled
RC1
IDLE
ICB 1 …
4
LIM0
9
C
H
00
H
00
H
00
H
LIM1
PCD
PCR
X
PM2...0
IMR0...
4
00
H
00
H
00
H
7B
H
,03
H
,00
H
FF
H,
FF
H,
FF
H,
FF
H,
FF
H,
00
H,
00
H,
00
H,
00
H,
00
H
00
H
FD
H
, FF
H
FF
H
, FF
H
RTR1...
4
TTR1...
4
MODE
PRE
RAH1/2
RAL1/2
No time slots selected
Signaling controller disabled
Preamble cleared
Compare register for receive address cleared
Table 39
Register
Initial Values after Reset (E1)
(cont’d)
Reset Value
Meaning
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