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參數(shù)資料
| 型號(hào)： | PEB2255 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 151/374頁 |
| 文件大?。?/td> | 5064K |
| 代理商： | PEB2255 |
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PEB 2255
FALC-LH V1.3
Functional Description T1/J1
Data Sheet
151
2000-07
5.5.6
Clear Channel Capability
For support of common T1 applications, clear channels can be specified via the 3-byte
register bank CCB1 … CCB3. In this mode the contents of selected transmit time slots
are not overwritten by internally or externally sourced bit-robbing and zero code
suppression (B7 stuffing) information. Remote alarm signaling, however, overwrites
cleared channels.
5.5.7
The FALC
-LH generates and detects a framed or unframed in-band loop-up/activate
(00001) and loop-down/deactivate (001) pattern according to ANSI T1.
4
03 with bit error
rates as high as 1/100. Framed or unframed in-band loop code is selected by
LCR1.FLLB. Replacing the in-band loop codes with transmit data is done by FMR5.
X
LD/
X
L
U
.
The FALC
-LH also offers the ability generating and detecting of a flexible in-band loop
up - and down pattern (LCR1.LLBP
=
1). The loop up and loop down pattern is individual
programmable from 2 to
8
bit in length (LCR1.LAC1/0 and LCR1.LDC1/0). Programming
of loop codes is done in registers LCR2 and LCR3.
Status and interrupt-status bits inform the user whether a loop-up or loop-down code was
detected.
In-Band Loop Generation and Detection
5.5.8
Transparent Mode
The transparent modes are useful for loopbacks or for routing data unchanged through
the FALC
-LH.
In receive direction, transparency for ternary or dual/single rail unipolar data is achieved
if the receiver is in the synchronous state and FMR5.RTF has been selected. All bits in
F-bit position of the incoming multiframe are forwarded to RDO and inserted in the FS/
DL time slot or in the F-bit position. In asynchronous state the received data may be
transparently switched through if bit FMR2.DAIS is set. Setting of bit LOOP.RTM
disconnects control of the elastic buffer from the receiver. The elastic buffer is now in a
“free running” mode without any possibility to update the time slot assignment to a new
frame position in case of re-synchronization of the receiver. Together with FMR2.DAIS
this function may be used to realize undisturbed transparent reception.
Setting bit FMR
4
.TM switches the FALC
-LH in transmit transparent mode:
In transmit direction bit
8
of the FS/DL time slot from the system highway (
X
DI) is inserted
in the F-bit position of the outgoing frame. For complete transparency the internal
signaling controller, IDLE code generation, AIS/RA alarm generation, single channel and
payload loop back has to be disabled and “Clear Channels” have to be defined via
registers CCB1
…
3.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEB2256 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PEB2256E | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PEB2256HT | SPROM PROGRAMMER ZIF SOCKET |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PEB22554 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:ICs for Communications |
| PEB22554-HT | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:ICs for Communications |
| PEB22554HT-V1.1 | 制造商:Siemens 功能描述: |
| PEB22554HTV1.3 | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| PEB2255H-V1.1 | 制造商:Siemens 功能描述: |
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