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參數(shù)資料
| 型號： | PSB7280 |
| 廠商： | SIEMENS A G |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | Joint Audio Decoder-Encoder |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP100 |
| 文件頁數(shù)： | 125/190頁 |
| 文件大?。?/td> | 2177K |
| 代理商： | PSB7280 |
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PSB 7280
Semiconductor Group
125
Data Sheet 1998-07-01
Receive Command Register
RCMD
Write
Address 25
H
Bit 7
RMC
Bit 0
RCMD
RRES
RMD
STR
RMC
Receive Message Complete
Acknowledges a previous RPF or RME status. Frees the FIFO pool for the
next received frame or part of a frame.
Although the interrupt status register (ISR) is automatically reset after read,
the RMC must be given in response to an RPF or RME interrupt to free the
FIFO.
The FIFO is not considered to be free, even if completely read. The read on
the FIFO can be done cyclically several times.
Receiver Reset
When RAC = 1, this command resets the HDLC receiver, clears the receive
FIFO and aborts any HDLC frame being received.
When RRES is issued while RAC = 0, this command initializes in addition
the time-slot count logic for this channel.
Receive Message Delete
Reaction to an RPF interrupt. The remaining part of the frame is to be
ignored by the receiver (which goes into the hunt mode
1)
(see
page 131
)
starting in the DSP/host inaccessible part of RFIFO); the receive FIFO is
cleared of that frame.
Start command for RFS generation
Only valid when RFIN = 0 (RFS pulses internally generated) and used if
RCONT bit in RFS mode register = 0.
When RCONT = 0
, when STR is set, exactly RREP(9-0) pulses of one bit
duration and spaced 16 bit periods from each other are generated. When
STR command is given, generation of pulses starts at the next possible
16-bit boundary.
This function may be used in connection with the HDLC controller when a
predefined number of data units (e.g. words) are received, clocked by RFS
pulses.
RRES
RMD
STR
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