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參數(shù)資料
| 型號(hào)： | PSB7280 |
| 廠商： | SIEMENS A G |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | Joint Audio Decoder-Encoder |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP100 |
| 文件頁數(shù)： | 54/190頁 |
| 文件大小： | 2177K |
| 代理商： | PSB7280 |
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PSB 7280
Semiconductor Group
54
Data Sheet 1998-07-01
The maskable interrupt status bits for controlling the transfer are:
or optionally:
In addition, the control bits HXA1 and HXA2 control whether the corresponding transmit
channel is loaded into the shift register from the XC1/2 register accessible from the DSP
(HXA = 0) or from the host (HXA = 1).
The block diagrams for the receive and transmit audio channels are shown in
Figure 21
and
Figure 22
.
Figure 21
BFUL
BEMP
Buffer full (RC1 or RC2).
Buffer empty (XC1 or XC2).
FSC
RFS
TFS
Frame sync interrupt (FSC).
Frame sync interrupt (RFS).
Frame sync interrupt (TFS).
M
U
X
10
DU
0x
11
SLIN
Time-slot
Count
Logic
Time-slot
Shift Register
Load*
TS-Clock
1 to 32 bits (LBIT)
2
SLIN
2
M
U
X
01
00
11
DD
SR
ST
10
LMOD
BFUL
5
LBIT
Receive 1,2:
FSC
DCL(/2)
RFS
SCLK
TFS
SCLK
32 bits
Host/DSP
RCx
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