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參數資料
| 型號： | PSB7280 |
| 廠商： | SIEMENS A G |
| 元件分類： | 消費家電 |
| 英文描述： | Joint Audio Decoder-Encoder |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP100 |
| 文件頁數： | 50/190頁 |
| 文件大小： | 2177K |
| 代理商： | PSB7280 |
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PSB 7280
Semiconductor Group
50
Data Sheet 1998-07-01
4.2
Audio and Data Reception/Transmission
The PSB 7280 supports a total of eight independent serial I/O-channels:
two receive and two transmit audio channels, and
two receive and two transmit data channels (pertaining to the two HDLC controllers).
The eight channels are transferred between the DSP and/or the parallel host interface
and one of the serial interface lines: DD or DU (IOM-2), or SR or ST (Serial Audio
Interface SAI). The capacity of each channel is individually determined by programming
the time-slot length on the selected serial interface line.
Timing Generation
The selection of the line for each of the channels is performed via SLIN1,0 (00: DU; 01:
DD; 10: SR; 11: ST). The timing logic is driven by the bit clock and frame synchronization
signals corresponding to the selected line. These are:
The IOM-2 timing signals can be input or output of the PSB 7280, i.e. the circuit is a slave
or master with respect to the IOM-2 interface. The selection is done by the CGEN bit in
register 202B
H
.
The timing on the SAI lines SR and ST is either input or output. In the case where the
timing is internally generated (i.e. the PSB 7280 functions as SAI master for SR and/or
ST), a schematic diagram of the generation logic is shown in
Figure 19
.
DCL(/2) and FSC
SCLK and RFS
SCLK and TFS
for DD and DU.
for SR.
for ST.
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PDF描述 |
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