參數(shù)資料
型號: TMX320TCI6482ZTZA8
廠商: Texas Instruments, Inc.
元件分類: 數(shù)字信號處理
英文描述: Communications Infrastructure Digital Signal Processor
中文描述: 通信基礎設施的數(shù)字信號處理器
文件頁數(shù): 141/255頁
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代理商: TMX320TCI6482ZTZA8
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www.ti.com
TMS320TCI6482
Communications Infrastructure Digital Signal Processor
SPRS246F–APRIL 2005–REVISED MAY 2007
8.7.3.5
PLL Controller Divider 5 Register
The PLL controller divider 5 register (PLLDIV5) is shown in
Figure 8-15
and described in
Table 8-23
.
31
16
Reserved
R-0
15
14
5
4
0
D5EN
Reserved
RATIO
R/W-1
LEGEND:
R/W = Read/Write; R = Read only; -
n
= value after reset
R-0
R/W-3
Figure 8-15. PLL Controller Divider 5 Register (PLLDIV5) [Hex Address: 029A 0164]
Table 8-23. PLL Controller Divider 5 Register (PLLDIV5) Field Descriptions
Bit
31:16
15
Field
Reserved
Dn4EN
Value
0
Description
Reserved. The reserved bit location is always read as 0. A value written to this field has no effect.
Divider 4 enable bit.
Divider 4 is disabled. No clock output.
Divider 4 is enabled.
Reserved. The reserved bit location is always read as 0. A value written to this field has no effect.
Divider ratio bits.
÷1. Divide frequency by 1.
÷2. Divide frequency by 2.
÷3. Divide frequency by 3.
÷4. Divide frequency by 4.
÷5 to ÷8. Divide frequency by 5 to divide frequency by 8.
Reserved, do not use.
0
1
0
14:5
4:0
Reserved
RATIO
0-1Fh
0
1h
2h
3h
4h-7h
8h-1Fh
Submit Documentation Feedback
C64x+ Peripheral Information and Electrical Specifications
141
相關PDF資料
PDF描述
TMX380SRAFNL Communications Interface
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TMX99532NL MODEM
TMXF281553BAL-3C-DB Telecomm/Datacomm
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參數(shù)描述
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TMX320VC33PGE 制造商:Texas Instruments 功能描述:
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