參數(shù)資料
型號: TMX320TCI6482ZTZA8
廠商: Texas Instruments, Inc.
元件分類: 數(shù)字信號處理
英文描述: Communications Infrastructure Digital Signal Processor
中文描述: 通信基礎(chǔ)設(shè)施的數(shù)字信號處理器
文件頁數(shù): 228/255頁
文件大小: 1893K
代理商: TMX320TCI6482ZTZA8
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www.ti.com
8.19.3 UTOPIA Electrical Data/Timing
UXCLK
1
2
3
4
4
URCLK
1
2
3
4
4
TMS320TCI6482
Communications Infrastructure Digital Signal Processor
SPRS246F–APRIL 2005–REVISED MAY 2007
Table 8-106. Timing Requirements for UXCLK
(1)
(see
Figure 8-74
)
-850
A-1000
-1000
MIN
20
NO.
UNIT
MAX
1
2
3
4
t
c(UXCK)
t
w(UXCKH)
t
w(UXCKL)
t
t(UXCK)
Cycle time, UXCLK
Pulse duration, UXCLK high
Pulse duration, UXCLK low
Transition time, UXCLK
ns
ns
ns
ns
0.4t
c(UXCK)
0.4t
c(UXCK)
0.6t
c(UXCK)
0.6t
c(UXCK)
2
(1)
The reference points for the rise and fall transitions are measured at V
IL
MAX and V
IH
MIN.
Figure 8-74. UXCLK Timing
Table 8-107. Timing Requirements for URCLK
(1)
(see
Figure 8-75
)
-850
A-1000
-1000
MIN
20
NO.
UNIT
MAX
1
2
3
4
t
c(URCK)
t
w(URCKH)
t
w(URCKL)
t
t(URCK)
Cycle time, URCLK
Pulse duration, URCLK high
Pulse duration, URCLK low
Transition time, URCLK
ns
ns
ns
ns
0.4t
c(URCK)
0.4t
c(URCK)
0.6t
c(URCK)
0.6t
c(URCK)
2
(1)
The reference points for the rise and fall transitions are measured at V
IL
MAX and V
IH
MIN.
Figure 8-75. URCLK Timing
228
C64x+ Peripheral Information and Electrical Specifications
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