- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄361591 > uPSD3233 (意法半導(dǎo)體) Flash Programmable System Device with 8032 Microcontroller Core(嵌入高速“8032微控制器核”的Flash型可編程系統(tǒng)器) PDF資料下載
參數(shù)資料
| 型號： | uPSD3233 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Flash Programmable System Device with 8032 Microcontroller Core(嵌入高速“8032微控制器核”的Flash型可編程系統(tǒng)器) |
| 中文描述： | 閃存可編程系統(tǒng)器件與8032微控制器內(nèi)核（嵌入高速“8032微控制器核”的閃存型可編程系統(tǒng)器） |
| 文件頁數(shù)： | 79/164頁 |
| 文件大?。?/td> | 1133K |
| 代理商： | UPSD3233 |
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μ
PSD3200 FAMILY
DRAFT(Thursday 20 June 2002, 13:15).
DDC2B Protocol
DDC2B is constructed base on Philips I
2
C inter-
face. However, in the level of DDC2B, PC host is
fixed as the master and the monitor is always re-
garded asthe slave.Both master and slave can be
operated as a transmitter or receiver, but themas-
ter device determines which mode is activated. In
this protocol, address pointer is also used.
According to DDC2B specification, A0(for write
mode) and A1(for read mode) are assigned as the
default address of monitors.
The reception of the incoming data in write mode
or the updating of the outgoingdata in read mode
should be finished within the specified time limit. If
software in the slave’s side cannot react to the
master in time, based on I
2
C protocol,SCL pin can
be stretched low to inhibit the further action from
the master. The transaction can be proceeded in
either byte or burst format.
Figure 40. Conceptual Structure of the DDC Interface
AI06645
DDC Interrupt
vector address
(
0023H
)
DDC2B/DDC2AB
Utilities
DDC2B
Utilities
DDC1.DDC2B
Utilities
Check Mode flag in DDCCON
Mode = 1 Mode = 1 Mode = 0
I2C
ServiceRoutines
I2C interface
(H/W)
DDC Transmitter
(H/W)
DDC2B/DDC2AB
commandreceived
DDC2B
SWENB =1
SWENB =0
SWENB =1
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