參數(shù)資料
型號(hào)： MCF5249VM140
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160
封裝： 15 X 15 MM, MAPBGA-160
文件頁(yè)數(shù)： 97/454頁(yè)
文件大小： 6701K
代理商： MCF5249VM140
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13-2
MCF5249UM
MOTOROLA
memory is connected. The IDE and SmartMedia interfaces share most signals with the ColdFire address
and data bus. The “second” bus buffer prevents the flash ROM signals from going to/from IDE and
SmartMedia interfaces.
To support this bus set-up, a number of signals are available.
BUFENB1: active-low external buffer enable. This enable is always active when CS0 is active, and
should enable a buffer going to the boot ROM.
BUFENB2: active-low external buffer enable. This enable is always inactive when CS0 is active,
and should enable a buffer for peripheral devices, except boot ROM.
IDE-DIOR, IDE-DIOW: active-low IDE bus read and write strobe.
IDE-IORDY: active-high “ready” indication from IDE device to MCF5249.
SRE, SWE: active-low SmartMedia read and write strobe
Note: The SWE and SRE signals are only used on the 160 MAPBGA package.
The extra bus signals, and their configuration are detailed in the following section.
13.1.1
BUFFER ENABLES BUFENB1, BUFENB2, AND ASSOCIATED LOGIC.
Buffer enables BUFENB1 and BUFENB2 allow a seamless interface to external bus buffers. The buffers
may be placed on the address and the data bus.
Figure 13-2 Buffer Enables (BUFENB1 and BUFENB2)
BUFENB1 is always active on CS0. BUFENB2 is never active on CS0. Either of the buffer enables can be
programmed to be active on CS1, CS2, or CS3.
As shown in Figure 13-2, the buffer enables
BUFENB1 and BUFENB2 will go active at time CSPRE
before the falling edge of the Chip Select signal, and continue to be active for a time CSPOST after the
rising edge of the chip select signal. The pre-drive time
CSPRE is realized by delaying the falling edge of
the select signal. If pre-drive time
CSPRE is programmed non-zero, and internal ColdFire cycle
termination is used, chip select length will be
CSPRE shorter than the programmed length. Times
CSPRE, CSPOST are the same for both BUFENB1 AND BUFENB2. Times CSPRE,
CSPOST are independently programmable for every select.
Buffer enable configuration is programmable using the
IDE_CONFIG1 register.
BUFENBx
CSPRE
CSPOST
CSx_core
bufenx_b
cspre
CS0, CS1,
DIOR, DIOW, SRE, SWE
cspost
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料
PDF描述
MCF5249VF140 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160
MCF5251CDVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF5251CEVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF5251EVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF54417CMJ250 MICROPROCESSOR, PBGA256
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MCF5251 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor
MCF5251_07 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor Data Sheet
MCF5251_08 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor
MCF5251CDVM140 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor
MCF5251CEVM140 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor
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