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參數(shù)資料
| 型號： | TSB12LV01BPZ |
| 英文描述： | FPGA (Field-Programmable Gate Array) |
| 中文描述： | 總線控制器 |
| 文件頁數(shù)： | 74/106頁 |
| 文件大小： | 605K |
| 代理商： | TSB12LV01BPZ |
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5
–
18
5.5
In this mode, when DMDONE is asserted high it will check for DMREADY low as an acknowledge. This is
equivalent to the mode used in the TSB12LV31 (GPLynx), as shown in Figure 5
–
31.
Data Mover Handshake Mode
DMCLK
DMRW
DMD[0:15]
DMREADY
DMPRE
DMDONE
Figure 5
–
31. Data Mover Handshake Mode (GPLynx mode)
5.6
Data Mover Critical Timing
Table 5
–
2. CLK to Output Timing With Respect to DMCLK
PARAMETER
TERMINAL NAME
DMDONE
MIN
1.75
MAX
8.5
UNIT
td0
td1
td2
td3
td4
td5
tsu0
tsu1
th0
th1
NOTE: All timing parameters are with respect to the rising edge of DMCLK
DMRW
1.75
7.5
Delay time (DMCLK to Q)
DMPRE
1.75
14.5
ns
DMERROR
1.5
11.5
PKTFLAG
DMD[0:15]
1.75
0.5
8.5
9
Setup time to DMCLK
DMREADY
14
ns
DMD[0:15]
14
Hold time from DMCLK
DMREADY
DMD[0:15]
–
1
ns
–
0.75
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TSB12LV26-EP | 672-pin FineLine BGA |
| TSB12LV22PZP | OHCI-Lynx PCI-BASED IEEE 1394 HOST CONTROLLER |
| TSB12LV26PZ | OHCI-Lynx PCI-BASED IEEE 1394 HOST CONTROLLER |
| TSB14AA1 | FPGA (Field-Programmable Gate Array) |
| TSB14AA1I | FPGA (Field-Programmable Gate Array) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TSB12LV01BPZT | 功能描述:1394 接口集成電路 High Perf 1394 3.3V Link Layer RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray |
| TSB12LV01BPZTG4 | 功能描述:1394 接口集成電路 High Perf 1394 3.3V Link Layer RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray |
| TSB12LV01PZ | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TSB12LV21 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:IEEE 1394 LINK LAYER CONTROLLER |
| TSB12LV21A | 制造商:TI 制造商全稱:Texas Instruments 功能描述:IEEE 1394-1995 BUS TO PCI BUS INTERFACE |
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