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參數(shù)資料
| 型號： | ARM7TDMI |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | general purpose 32-bit microprocessors |
| 中文描述： | 通用32位微處理器 |
| 文件頁數(shù)： | 160/268頁 |
| 文件大?。?/td> | 1289K |
| 代理商： | ARM7TDMI |
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Memory Interface
ARM7TDMI Data Sheet
ARM DDI 0029E
6-8
O
Previous ARM processors included the
ALE
signal, and this is retained for backwards
compatibility. This signal also allows the address timing to be modified to achieve the
same results as
APE
, but in an asynchronous manner. To obtain clean
MCLK
low
timing of the address bus by this mechanism,
ALE
must be driven HIGH with the falling
edge of
MCLK
, and LOW with the rising edge of
MCLK
.
ALE
can simply be the inverse
of
MCLK
but the delay from
MCLK
to
ALE
must be carefully controlled such that the
Tald
timing constraint is achieved.
·
Figure 6-6: SRAM compatible address timing
shows how
ALE
can be used to achieve SRAM compatible address timing. Refer to
·
Chapter 12, AC Parameters
for details of the exact timing constraints.
Figure 6-6: SRAM compatible address timing
Note
If
ALE
is to be used to change address timing, then
APE
must be tied HIGH. Similarly,
if
APE
is to be used,
ALE
must be tied HIGH.
MCLK
APE
ALE
nMREQ
SEQ
A[31:0]
D[31:0]
相關(guān)PDF資料 |
PDF描述 |
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