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參數(shù)資料
| 型號(hào)： | ARM7TDMI |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | general purpose 32-bit microprocessors |
| 中文描述： | 通用32位微處理器 |
| 文件頁數(shù)： | 200/268頁 |
| 文件大?。?/td> | 1289K |
| 代理商： | ARM7TDMI |
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Debug Interface
ARM7TDMI Data Sheet
ARM DDI 0029E
8-20
O
From this point on, the processor's state can be determined by the sequences of ARM
instructions described below.
Once the processor is in ARM state, typically the first instruction executed would be:
STM R0, {R0-R15}
This causes the contents of the registers to be made visible on the data bus. These
values can then be sampled and shifted out.
Note
The above use of R0 as the base register for the STM is for illustration only, any
register could be used.
After determining the values in the current bank of registers, it may be desirable to
access the banked registers. This can only be done by changing mode. Normally, a
mode change may only occur if the core is already in a privileged mode. However,
while in debug state, a mode change from any mode into any other mode may occur.
Note that the debugger must restore the original mode before exiting debug state.
For example, assume that the debugger had been asked to return the state of the
USER mode and FIQ mode registers, and debug state was entered in supervisor
mode.
The instruction sequence could be:
STM R0, {R0-R15}; Save current registers
MRS R0, CPSR
STR R0, R0; Save CPSR to determine current mode
BIC R0, 0x1F; Clear mode bits
ORR R0, 0x10; Select user mode
MSR CPSR, R0; Enter USER mode
STM R0, {R13,R14}; Save register not previously visible
ORR R0, 0x01; Select FIQ mode
MSR CPSR, R0; Enter FIQ mode
STM R0, {R8-R14}; Save banked FIQ registers
All these instructions are said to execute at
debug speed
. Debug speed is much
slower than system speed since between each core clock, 33 scan clocks occur in
order to shift in an instruction, or shift out data. Executing instructions more slowly than
usual is fine for accessing the core’s state since ARM7TDMI is fully static. However,
this same method cannot be used for determining the state of the rest of the system.
While in debug state, only the following instructions may legally be scanned into the
instruction pipeline for execution:
all data processing operations, except TEQP
all load, store, load multiple and store multiple instructions
MSR and MRS
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