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參數資料
| 型號： | ARM7TDMI |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | general purpose 32-bit microprocessors |
| 中文描述： | 通用32位微處理器 |
| 文件頁數： | 225/268頁 |
| 文件大小： | 1289K |
| 代理商： | ARM7TDMI |
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ICEBreaker Module
ARM7TDMI Data Sheet
ARM DDI 0029E
9-15
O
The following instructions should be used:
MRC CP14, 0, Rd, C0, C0
Returns the Debug Comms Control register into Rd
MCR CP14, 0, Rn, C1, C0
Writes the value in Rn to the Comms Data Write register
MRC CP14, 0, Rd, C1, C0
Returns the Debug Data Read register into Rd
Since the THUMB instruction set does not contain coprocessor instructions, it is
recommended that these are accessed via SWI instructions when in THUMB state.
9.11.2 Communications via the comms channel
Communication between the debugger and the processor occurs as follows. When the
processor wishes to send a message to ICEbreaker, it first checks that the Comms
Data Write register is free for use. This is done by reading the Debug Comms Control
register to check that the W bit is clear. If it is clear then the Comms Data Write register
is empty and a message is written by a register transfer to the coprocessor. The action
of this data transfer automatically sets the W bit. If on reading the W bit it is found to
be set, then this implys that previously written data has not been picked up by the
debugger and thus the processor must poll until the W bit is clear.
As the data transfer occurs from the processor to the Comms Data Write register, the
W bit is set in the Debug Comms Control register. When the debugger polls this
register it sees a synchronised version of both the R and W bit. When the debugger
sees that the W bit is set it can read the Comms Data Write register and scan the data
out. The action of reading this data register clears the W bit of the Debug Comms
Control register. At this point, the communications process may begin again.
Message transfer from the debugger to the processor is carried out in a similar
fashion. Here, the debugger polls the R bit of the Debug Comms Control register. If the
R bit is low then the Data Read register is free and so data can be placed there for the
processor to read. If the R bit is set, then previously deposited data has not yet been
collected and so the debugger must wait.
When the Comms Data Read register is free, data is written there via the scan chain.
The action of this write sets the R bit in the Debug Comms Control register. When the
processor polls this register, it sees an MCLK synchronised version. If the R bit is set
then this denotes that there is data waiting to be collected, and this can be read via a
CPRT load. The action of this load clears the R bit in the Debug Comms Control
register. When the debugger polls this register and sees that the R bit is clear, this
denotes that the data has been taken and the process may now be repeated.
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