參數(shù)資料
型號: DK-DEV-2AGX125N
廠商: Altera
文件頁數(shù): 18/90頁
文件大小: 0K
描述: KIT DEV ARRIA II GX FPGA 2AGX125
產(chǎn)品培訓(xùn)模塊: Arria II GX FPGA
Three Reasons to Use FPGA's in Industrial Designs
特色產(chǎn)品: Arria? II GX FPGA Development Kit
標(biāo)準(zhǔn)包裝: 1
系列: Arria II GX
類型: FPGA
適用于相關(guān)產(chǎn)品: EP2AGX125EF35
所含物品: 板,線纜,CD,DVD,電源
產(chǎn)品目錄頁面: 605 (CN2011-ZH PDF)
相關(guān)產(chǎn)品: 544-2599-5-ND - IC ARRIA II GX 125K 1152FBG
544-2598-5-ND - IC ARRIA II GX 125K 1152FBG
544-2597-5-ND - IC ARRIA II GX 125K 1152FBG
其它名稱: 544-2600
Chapter 1: Device Datasheet for Arria II Devices
1–17
Electrical Characteristics
December 2013
Altera Corporation
Table 1–26 lists the single-ended SSTL and HSTL I/O standard signal specifications
for Arria II GX devices.
Table 1–27 lists the single-ended SSTL and HSTL I/O standard signal specifications
for Arria II GZ devices.
Table 1–26. Single-Ended SSTL and HSTL I/O Standard Signal Specifications for Arria II GX Devices
I/O Standard
VIL(DC) (V)
VIH(DC) (V)
VIL(AC) (V)
VIH(AC) (V)
VOL (V)
VOH (V)
IOL
(mA)
IOH
(mA)
Min
Max
Min
Max
Min
Max
Min
SSTL-2 Class I
–0.3
VREF -
0.18
VREF +
0.18
VCCIO +
0.3
VREF - 0.35
VREF +
0.35
VTT -
0.57
VTT +
0.57
8.1
–8.1
SSTL-2 Class II
–0.3
VREF -
0.18
VREF +
0.18
VCCIO +
0.3
VREF - 0.35
VREF +
0.35
VTT -
0.76
VTT +
0.76
16.4
–16.4
SSTL-18 Class I
–0.3
VREF -
0.125
VREF +
0.125
VCCIO +
0.3
VREF - 0.25
VREF +
0.25
VTT -
0.475
VTT +
0.475
6.7
–6.7
SSTL-18 Class II
–0.3
VREF -
0.125
VREF +
0.125
VCCIO +
0.3
VREF - 0.25
VREF +
0.25
0.28
VCCIO -
0.28
13.4
–13.4
SSTL-15 Class I
–0.3
VREF -
0.1
VREF +
0.1
VCCIO +
0.3
VREF - 0.175
VREF +
0.175
0.2 ×
VCCIO
0.8 ×
VCCIO
8–8
SSTL-15 Class II
–0.3
VREF -
0.1
VREF +
0.1
VCCIO +
0.3
VREF - 0.175
VREF +
0.175
0.2 ×
VCCIO
0.8 ×
VCCIO
16
–16
HSTL-18 Class I
–0.3
VREF -
0.1
VREF +
0.1
VCCIO +
0.3
VREF - 0.2
VREF + 0.2
0.4
VCCIO -
0.4
8–8
HSTL-18 Class II
–0.3
VREF -
0.1
VREF +
0.1
VCCIO +
0.3
VREF - 0.2
VREF + 0.2
0.4
VCCIO -
0.4
16
–16
HSTL-15 Class I
–0.3
VREF -
0.1
VREF +
0.1
VCCIO +
0.3
VREF - 0.2
VREF + 0.2
0.4
VCCIO -
0.4
8–8
HSTL-15 Class II
–0.3
VREF -
0.1
VREF +
0.1
VCCIO +
0.3
VREF - 0.2
VREF + 0.2
0.4
VCCIO -
0.4
16
–16
HSTL-12 Class I
–0.15
VREF -
0.08
VREF +
0.08
VCCIO +
0.15
VREF - 0.15
VREF +
0.15
0.25 ×
VCCIO
0.75 ×
VCCIO
8–8
HSTL-12 Class II
–0.15
VREF -
0.08
VREF +
0.08
VCCIO +
0.15
VREF - 0.15
VREF +
0.15
0.25 ×
VCCIO
0.75 ×
VCCIO
14
–14
Table 1–27. Single-Ended SSTL and HSTL I/O Standards Signal Specifications for Arria II GZ Devices (Part 1 of 2)
I/O Standard
VIL(DC) (V)
VIH(DC) (V)
VIL(AC) (V)
VIH(AC) (V)
VOL (V)
VOH (V)
IOL
(mA)
IOH
(mA)
Min
Max
Min
Max
Min
Max
Min
SSTL-2 Class I
-0.3
VREF -
0.15
VREF +
0.15
VCCIO +
0.3
VREF -
0.31
VREF +
0.31
VTT -
0.57
VTT +
0.57
8.1
-8.1
SSTL-2 Class II
-0.3
VREF -
0.15
VREF +
0.15
VCCIO +
0.3
VREF -
0.31
VREF +
0.31
VTT -
0.76
VTT +
0.76
16.2
-16.2
SSTL-18 Class I
-0.3
VREF -
0.125
VREF +
0.125
VCCIO +
0.3
VREF -
0.25
VREF +
0.25
VTT -
0.475
VTT +
0.475
6.7
-6.7
SSTL-18 Class II
-0.3
VREF -
0.125
VREF +
0.125
VCCIO +
0.3
VREF -
0.25
VREF +
0.25
0.28
VCCIO -
0.28
13.4
-13.4
SSTL-15 Class I
VREF -
0.1
VREF +
0.1
VREF -
0.175
VREF +
0.175
0.2 ×
VCCIO
0.8 ×
VCCIO
8-8
相關(guān)PDF資料
PDF描述
DK-V6-EMBD-G-J DEV KIT EMBEDDED VIRTEX 6
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參數(shù)描述
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DK-DEV-3C120N 功能描述:可編程邏輯 IC 開發(fā)工具 FPGA Development Kit For EP3C120F780 RoHS:否 制造商:Altera Corporation 產(chǎn)品:Development Kits 類型:FPGA 工具用于評估:5CEFA7F3 接口類型: 工作電源電壓:
DK-DEV-3CLS200N 功能描述:可編程邏輯 IC 開發(fā)工具 FPGA Development Kit For EP3CLS200F780 RoHS:否 制造商:Altera Corporation 產(chǎn)品:Development Kits 類型:FPGA 工具用于評估:5CEFA7F3 接口類型: 工作電源電壓:
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