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參數(shù)資料
| 型號： | DK-DEV-2AGX125N |
| 廠商： | Altera |
| 文件頁數(shù)： | 43/90頁 |
| 文件大小： | 0K |
| 描述： | KIT DEV ARRIA II GX FPGA 2AGX125 |
| 產(chǎn)品培訓(xùn)模塊： | Arria II GX FPGA Three Reasons to Use FPGA's in Industrial Designs |
| 特色產(chǎn)品： | Arria? II GX FPGA Development Kit |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Arria II GX |
| 類型： | FPGA |
| 適用于相關(guān)產(chǎn)品： | EP2AGX125EF35 |
| 所含物品： | 板，線纜，CD，DVD，電源 |
| 產(chǎn)品目錄頁面： | 605 (CN2011-ZH PDF) |
| 相關(guān)產(chǎn)品： | 544-2599-5-ND - IC ARRIA II GX 125K 1152FBG 544-2598-5-ND - IC ARRIA II GX 125K 1152FBG 544-2597-5-ND - IC ARRIA II GX 125K 1152FBG |
| 其它名稱： | 544-2600 |
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1–40
Chapter 1: Device Datasheet for Arria II Devices
Switching Characteristics
December 2013
Altera Corporation
Total jitter
(peak-to-peak)
Pattern = CRPAT
—
0.27
9
—
0.279
—
0.279
—
0.279
UI
GIGE Receiver Jitter Tolerance (6)
Deterministic
jitter tolerance
(peak-to-peak)
Pattern = CJPAT
> 0.4
UI
Combined
deterministic and
random jitter
tolerance
(peak-to-peak)
Pattern = CJPAT
> 0.66
UI
HiGig Transmit Jitter Generation (7)
Deterministic
jitter
(peak-to-peak)
Data rate =
3.75 Gbps
Pattern = CJPAT
—
0.17
—
0.17
—
UI
Total jitter
(peak-to-peak)
Data rate =
3.75 Gbps
Pattern = CJPAT
—
0.35
—
0.35
—
UI
HiGig Receiver Jitter Tolerance (7)
Deterministic
jitter tolerance
(peak-to-peak)
Data rate =
3.75 Gbps
Pattern = CJPAT
> 0.37
—
UI
Combined
deterministic and
random jitter
tolerance
(peak-to-peak)
Data rate =
3.75 Gbps
Pattern = CJPAT
> 0.65
—
UI
Sinusoidal jitter
tolerance
(peak-to-peak)
Jitter frequency =
22.1 KHz
Data rate =
3.75 Gbps
Pattern = CJPAT
> 8.5
—
UI
Jitter frequency =
1.875MHz
Data rate =
3.75 Gbps
Pattern = CJPAT
> 0.1
—
UI
Jitter frequency =
20 MHz
Data rate =
3.75 Gbps
Pattern = CJPAT
> 0.1
—
UI
Table 1–40. Transceiver Block Jitter Specifications for Arria II GX Devices (Note 1) (Part 4 of 10)
Symbol/
Description
Conditions
I3
C4
C5, I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
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