參數(shù)資料
型號： DK-DEV-2AGX125N
廠商： Altera
文件頁數(shù)： 24/90頁
文件大?。?/td> 0K
描述： KIT DEV ARRIA II GX FPGA 2AGX125
產(chǎn)品培訓(xùn)模塊： Arria II GX FPGA
Three Reasons to Use FPGA's in Industrial Designs
特色產(chǎn)品： Arria? II GX FPGA Development Kit
標(biāo)準(zhǔn)包裝： 1
系列： Arria II GX
類型： FPGA
適用于相關(guān)產(chǎn)品： EP2AGX125EF35
所含物品： 板，線纜，CD，DVD，電源
產(chǎn)品目錄頁面： 605 (CN2011-ZH PDF)
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544-2598-5-ND - IC ARRIA II GX 125K 1152FBG
544-2597-5-ND - IC ARRIA II GX 125K 1152FBG
其它名稱： 544-2600
Ch
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1:
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Spread-spectrum
downspread
PCIe
—
0 to
–0.5%
——
0 to
–0.5%
——
0 to
–0.5%
——
0 to
–0.5%
——
On-chip
termination
resistors
—
100
—
100
—
100
—
100
—
VICM
(AC coupled)
—
1100 ± 5%
mV
VICM
(DC coupled)
HCSL I/O
standard for
PCIe
reference
clock
250
—
550
250
—
550
250
—
550
250
—
550
mV
Transmitter
REFCLK Phase
Noise
10 Hz
—
-50
—
-50
—
-50
—
-50
dBc/Hz
100 Hz
—
-80
—
-80
—
-80
—
-80
dBc/Hz
1 KHz
—
-110
—
-110
—
-110
—
-110
dBc/Hz
10 KHz
—
-120
—
-120
—
-120
—
-120
dBc/Hz
100 KHz
—
-120
—
-120
—
-120
—
-120
dBc/Hz
1 MHz
—
-130
—
-130
—
-130
—
-130
dBc/Hz
Transmitter
REFCLK Phase
Jitter (rms) for
100 MHz
REFCLK (3)
10 KHz to
20 MHz
——
3
—
3
—
3
—
3
ps
Rref
——
2000
±1%
——
2000
±1%
——
2000
±1%
——
2000 ±
1%
—
Transceiver Clocks
Calibration block
clock frequency
(cal_blk_clk)
—
10
—
125
10
—
125
10
—
125
10
—
125
MHz
Table 1–34. Transceiver Specifications for Arria II GX Devices (Note 1) (Part 2 of 7)
Symbol/
Description
Condition
I3
C4
C5 and I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
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PDF描述
DK-V6-EMBD-G-J DEV KIT EMBEDDED VIRTEX 6
VE-J5V-EZ CONVERTER MOD DC/DC 5.8V 25W
AP432AL-13 IC VREF SHUNT PREC ADJ 8-SOP
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RCM15DRXS CONN EDGECARD 30POS DIP .156 SLD
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