- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377000 > DSP16410 16-bit fixed point DSP with Flash PDF資料下載
參數(shù)資料
| 型號： | DSP16410 |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-bit fixed point DSP with Flash |
| 中文描述： | 具有閃存的 16 位定點 DSP |
| 文件頁數(shù)： | 151/373頁 |
| 文件大小： | 5643K |
| 代理商： | DSP16410 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁當(dāng)前第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁第311頁第312頁第313頁第314頁第315頁第316頁第317頁第318頁第319頁第320頁第321頁第322頁第323頁第324頁第325頁第326頁第327頁第328頁第329頁第330頁第331頁第332頁第333頁第334頁第335頁第336頁第337頁第338頁第339頁第340頁第341頁第342頁第343頁第344頁第345頁第346頁第347頁第348頁第349頁第350頁第351頁第352頁第353頁第354頁第355頁第356頁第357頁第358頁第359頁第360頁第361頁第362頁第363頁第364頁第365頁第366頁第367頁第368頁第369頁第370頁第371頁第372頁第373頁
Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
95
4 Hardware Architecture
(continued)
4.13 Direct Memory Access Unit
(DMAU)
(continued)
4.13.9 Programming Examples
(continued)
4.13.9.1 SWT Example 1: A Two-Dimensional
Array
(continued)
The user software running in CORE0 must perform the
following steps to properly initialize SWT0:
1. The user software sets the source address
(
SADD0
—
Table 37 on page 76
) and the source
base address (
SBAS0
—
Table 44 on page 80
) to the
top of the output (source) array located in
TPRAM0. The user software writes 0x00002000 to
SADD0
and 0x02000 to
SBAS0
.
2. The user software sets the destination address
(
DADD0
—
Table 37 on page 76
) and the destination
base address (
DBAS0
—
Table 45 on page 80
) to the
top of the input (destination) array located in
TPRAM0. The user software writes 0x00001000 to
DADD0
and 0x01000 to
DBAS0
.
3. The user software clears the source and destination
counter registers
SCNT0
and
DCNT0
(
Table 38 on
page 77
and
Table 40 on page 78
).
4. The user software initializes the limit register
(
LIM0
—
Table 42 on page 79
) with the dimensions of
the array. The number of rows (or elements) is 2r
(
320), so the user software writes 319 (2r – 1) into
the LASTROW[12:0] field (
LIM0
[19:7]). The number
of columns is 4, so the user software writes 3 (n – 1)
into the LASTCOL[6:0] field (
LIM0
[6:0]). The user
software writes 0x09F83 into
LIM0
.
5. The user software initializes the stride register
(
STR0
—
Table 46 on page 81
) with the distance
between corresponding rows of consecutive col-
umns. Because the buffers are contiguous in this
example, the stride is the same as the buffer length
and the user software writes 0x0140 into
STR0
.
6. The user software initializes the reindex register
(
RI0
—
Table 47 on page 81
) with the sign-magnitude
postmodification value to be applied to
SADD0
and
DADD0
after each time that the last column has
been accessed. The magnitude of the reindex value
is ((2r
×
(n – 1)) – 1) or (320
×
3) – 1 = 959 = 0x3BF.
The sign must be negative, so the user software
writes 0x803BF into
RI0
.
7. The user software writes the control registers to
enable SWT0 and begin I/O processing. First, the
user software writes one into the POSTMOD[1:0]
field (
CTL0
[5:4]—
Table 34 on page 73
) to enable
two-dimensional array accesses, writes 0x3 to the
SIGCON[2:0] field (
CTL0
[3:1]), and writes 1 to the
AUTOLOAD field (
CTL0
[0]) so that no further core
interaction is needed. The user software writes
0x0017 to
CTL0
.
8. Finally, the user software sets both the SRUN0 and
DRUN0 fields (
DMCON0
[0] and
DMCON0
[4]—
Table 31 on page 70
) to enable SWT0 source and
destination transfers. The user software writes
0x0011 to
DMCON0
.
The DMAU begins processing the SWT0 input and out-
put channels. For the output channel, the DMAU per-
forms the following steps:
1. It reads the single word at the TPRAM0 location
pointed to by
SADD0
(0x00002000) and transfers
the data to SIU0. This data is the first output sample
for the first logical channel (ROW = 0 and COL = 0).
2. It increments
SADD0
by the contents of
STR0
, so
SADD0
contains 0x00002140 and points to the first
output sample for the second logical channel
(ROW = 0 and COL = 1). It updates
SCNT0
by
incrementing the column counter, so
SCNT0
con-
tains 0x00001.
3. It reads the data at 0x02140 and transfers it to SIU0.
4. It increments
SADD0
by the contents of
STR0
, so
SADD0
contains 0x00002280 and points to the first
output sample for the third logical channel (ROW = 0
and COL = 2). It updates
SCNT0
by incrementing
the column counter, so
SCNT0
contains 0x00002.
5. As in steps 3 and 4, the DMAU continues to read
data, transfer the data to SIU0, and update
SADD0
and
SCNT0
until the column counter equals the last
column (
SCNT0
[6:0] =
LIM0
[6:0] = 3).
SADD0
con-
tains 0x000023C0 and points to the first row of the
last column.
6. The DMAU subtracts the magnitude of the contents
of
RI0
from
SADD0
(0x000023C0 – 0x3BF) and
places the result into
SADD0
(0x00002001).
SADD0
points to the second output sample for the
first logical channel (ROW = 1 and COL = 0).
The DMAU continues processing in this manner until it
processes row 159 of column 3. At this point,
ROW = LASTROW/2 and COL = LASTCOL. Because
this condition is met and SIGCON[2:0] = 0x3, the
DMAU asserts the DSINT0 interrupt to CORE0.
CORE0’s ISR changes SIGCON[2:0]
to
0x5 so that the
DMAU asserts DSINT0 again after it has processed the
remaining samples in the buffers. CORE0 can over-
write the already-processed samples while the DMAU
continues to process the remaining samples.
The steps performed by the DMAU for the input chan-
nel are similar to those for the output channel.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DSP25-16AR | Phase-leg Rectifier Diode |
| DSP25 | Phase-leg Rectifier Diode |
| DSP25-12A | Phase-leg Rectifier Diode |
| DSP25-12AT | Phase-leg Rectifier Diode |
| DSP25-16A | Phase-leg Rectifier Diode |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DSP16410C | 制造商:AGERE 制造商全稱:AGERE 功能描述:DSP1629 Digital Signal Processor |
| DSP16410CG | 制造商:AGERE 制造商全稱:AGERE 功能描述:DSP16410CG Digital Signal Processor |
| DSP16411 | 制造商:AGERE 制造商全稱:AGERE 功能描述:DSP16411 Digital Signal Processor |
| DSP1643 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
| DSP1648C | 制造商:AGERE 制造商全稱:AGERE 功能描述:Host-Based Controller V.92 Modem Chip Set |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。