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參數(shù)資料
| 型號(hào)： | DSP16410 |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-bit fixed point DSP with Flash |
| 中文描述： | 具有閃存的 16 位定點(diǎn) DSP |
| 文件頁(yè)數(shù)： | 93/373頁(yè) |
| 文件大?。?/td> | 5643K |
| 代理商： | DSP16410 |
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
37
4 Hardware Architecture
(continued)
4.5 Memory Maps
The DSP16000 core is a modified Harvard architecture with separate program and data memory spaces
(X-memory space and Y-memory space). The core differentiates between the X- and Y-memory spaces by the
addressing unit used for the access (XAAU vs. YAAU) and not by the physical memory accessed. The core
accesses its X-memory space via its 20-bit X address bus (XAB) and 32-bit X data bus (XDB). The core accesses
its Y-memory space via its 20-bit Y address bus (YAB) and 32-bit Y data bus (YDB).
The DMAU accesses private internal memory (TPRAM
0—1
) via its 20-bit internal Z address bus (ZIAB) and
32-bit internal Z data bus (ZIDB) and shared external memory
1
(EIO and ERAM) via its 20-bit external Z address
bus (ZEAB) and 32-bit external Z data bus (ZEDB).
Although DSP16410B memory is 16-bit word-addressable, data or instruction widths can be either 16 bits or
32 bits and applications can access the memories 32 bits at a time.
Table 11
summarizes the components of the DSP16410B memory. The table specifies the name and size of each
component, whether it is internal or external, whether it is private to a core or shared by both cores, and in which
memory space(s) it resides. The five memory spaces are CORE0’s X-memory space, CORE0’s Y-memory space,
CORE1’s X-memory space, CORE1’s Y-memory space, and the DMAU’s Z-memory space.
Table 11. DSP16410B Memory Components
The remainder of this section consists of the following:
Section 4.5.1, Private Internal Memory, on page 38
.
Section 4.5.2, Shared Internal I/O, on page 38
.
Section 4.5.3, Shared External I/O and Memory, on page 38
.
Section 4.5.4, X-Memory Map, on page 39
.
Section 4.5.5, Y-Memory Maps, on page 40
.
Section 4.5.6, Z-Memory Maps, on page 41
.
Section 4.5.7, Internal I/O Detailed Memory Map, on page 42
.
1. ZEAB and ZEDB connect to EIO and ERAM through the SEMI.
Type
Memory
Component
Size
CORE0
CORE1
DMAU
Z-Memory
Space
X-Memory
Space
Y-Memory
Space
X-Memory
Space
Y-Memory
Space
Private Internal
TPRAM0
CACHE0
IROM0
TPRAM1
CACHE1
IROM1
Internal I/O
EIO
ERAM
EROM
96 Kwords
62 words
4 Kwords
96 Kwords
62 words
4 Kwords
128 Kwords
128 Kwords
512 Kwords
512 Kwords
Shared Internal
Shared External
Assumes that WEROM is 0 for normal operation. If WEROM is 1, ERAM is replaced by EROM in the memory space, allowing the normally
read-only EROM section to be written. WEROM is discussed in detail in
Section 4.5.3 on page 38
.
The internal I/O section consists of 2 Kwords of SLM and memory-mapped registers in the SEMI, DMAU, PIU, SIU0, and SIU1 blocks. Only a
small portion of the 128 Kwords reserved for internal I/O is actually populated with memory or registers.
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