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參數(shù)資料
| 型號(hào)： | DSP16410 |
| 元件分類(lèi)： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-bit fixed point DSP with Flash |
| 中文描述： | 具有閃存的 16 位定點(diǎn) DSP |
| 文件頁(yè)數(shù)： | 237/373頁(yè) |
| 文件大?。?/td> | 5643K |
| 代理商： | DSP16410 |
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
181
4 Hardware Architecture
(continued)
4.16 Serial Interface Unit (SIU)
(continued)
4.16.15 Registers
Each SIU contains 21 control, status, and data regis-
ters as summarized in
Table 100
. These can be func-
tionally grouped as:
Thirteen control registers (
SCON
0—12
)
Two status registers (
STAT
and
FSTAT
)
One read-only input data register (
SIDR
)
One write-only output register (
SODR
)
Two input channel index registers (
ICIX
0—1
)
Two output channel index registers (
OCIX
0—1
)
All of these 16-bit registers are aligned on even
addresses in DSP16410B shared I/O memory space.
The remainder of this section provides detail on each of
these registers.
Table 100
summarizes all the SIU memory-mapped
registers. Tables
101
through
119
describe each regis-
ter individually.
Table 100. SIU Registers
Register
Name
SCON0
SCON1
SCON2
SCON3
SCON4
SCON5
SCON6
SCON7
SCON8
SCON9
SCON10
SCON11
SCON12
SIDR
SODR
STAT
FSTAT
OCIX0
OCIX1
ICIX0
ICIX1
Address
SIU0
0x43000
0x43002
0x43004
0x43006
0x43008
0x4300A
0x4300C
0x4300E
0x43010
0x43012
0x43014
0x43016
0x43018
0x4301A
0x4301C
0x4301E
0x43020
0x43030
0x43032
0x43040
0x43042
Description
Size
(Bits)
16
R/W
Type
Reset
Value
0x0000
0x0400
0x0400
0x0000
0x0000
0x0000
0x0000
0x0000
0x0000
0x0000
0x0000
0x0000
0x8000
0x0000
SIU1
0x44000 SIU Input/Output General Control
0x44002 SIU Input Frame Control
0x44004 SIU Output Frame Control
0x44006 SIU Input/Output Subframe Control
0x44008 SIU Input Even Subframe Valid Vector Control
0x4400A SIU Input Odd Subframe Valid Vector Control
0x4400C SIU Output Even Subframe Valid Vector Control
0x4400E SIU Output Odd Subframe Valid Vector Control
0x44010 SIU Output Even Subframe Mask Vector Control
0x44012 SIU Output Odd Subframe Mask Vector Control
0x44014 SIU Input/Output General Control
0x44016 SIU Input/Output Active Clock Control
0x44018 SIU Input/Output Active Frame Sync Control
0x4401A SIU Input Data
0x4401C SIU Output Data
0x4401E SIU Input/Output General Status
0x44020 SIU Input/Output Frame Status
0x44030 SIU Output Channel Index for Even Subframes
0x44032 SIU Output Channel Index for Odd Subframes
0x44040 SIU Input Channel Index for Even Subframes
0x44042 SIU Input Channel Index for Odd Subframes
R/W
control
16
R
W
data
16
16
16
R/W
§
R
R/W
c & s
status
control
0x0000
0x0000
0x0000
16
R/W
control
0x0000
The SIU memory-mapped register sizes represent bits used. The registers are right-justified and padded to 32 bits (the unused upper bits are zero-
filled).
c & s means control and status.
§ All bits of
STAT
are readable, and some can be written with one to clear them.
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