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參數(shù)資料
| 型號(hào)： | DSP16410 |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-bit fixed point DSP with Flash |
| 中文描述： | 具有閃存的 16 位定點(diǎn) DSP |
| 文件頁(yè)數(shù)： | 321/373頁(yè) |
| 文件大?。?/td> | 5643K |
| 代理商： | DSP16410 |
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
265
9 Device Characteristics
9.1 Absolute Maximum Ratings
Stresses in excess of the absolute maximum ratings can cause permanent damage to the device. These are abso-
lute stress ratings only. Functional operation of the device is not implied at these or any other conditions in excess
of those given in the operational sections of the data sheet. Exposure to absolute maximum ratings for extended
periods can adversely affect device reliability.
External leads can be bonded and soldered safely at temperatures of up to 220
°
C.
9.2 Handling Precautions
All MOS devices must be handled with certain precautions to avoid damage due to the accumulation of static
charge. Although input protection circuitry has been incorporated into the devices to minimize the effect of this
static buildup, proper precautions should be taken to avoid exposure to electrostatic discharge during handling and
mounting. Agere Systems employs a human-body model for ESD-susceptibility testing. Since the failure voltage
of electronic devices is dependent on the current, voltage, and hence, the resistance and capacitance, it is impor-
tant that standard values be employed to establish a reference by which to compare test data. Values of 100 pF
and 1500
are the most common and are the values used in the Agere Systems human-body model test circuit.
The breakdown voltage for the DSP16410B is greater than 1000 V.
9.3 Recommended Operating Conditions
The ratio of the instruction cycle rate to the input clock frequency is 1:1 without the PLL and
((M + 2)/((D + 2) * f(OD))):1 with the PLL selected.
The maximum input clock (CKI pin) frequency when the PLL
is not selected as the device clock source is 50 MHz. The maximum input clock frequency is 40 MHz when
the PLL is selected.
Table 175. Absolute Maximum Ratings for Supply Pins
Parameter
Min
–0.5
–0.5
–0.5
V
SS
– 0.3
Max
2.0
2.0
4.0
Unit
V
V
V
V
Voltage on V
DD
1 with Respect to Ground
Voltage on V
DD
1A with Respect to Ground
Voltage on V
DD
2 with Respect to Ground
Voltage Range on Any Signal Pin
V
DD
2 + 0.3
4.0
125
150
Junction Temperature (T
J
)
Storage Temperature Range
–40
–40
°
C
°
C
Table 176. Recommended Operating Conditions
Maximum
Internal Clock
(CLK) Frequency
185 MHz
Minimum
Internal Clock
(CLK) Period T
5.4 ns
Junction
Temperature T
J
(
°
C)
Min
–40
Supply Voltage
V
DD
1, V
DD
1A (V)
Min
1.71
Supply Voltage
V
DD
2 (V)
Min
3.0
Max
120
Max
1.95
Max
3.6
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