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參數(shù)資料
| 型號： | MB90V560CR |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 8 MHz, MICROCONTROLLER, CPGA256 |
| 封裝： | PGA-256 |
| 文件頁數(shù)： | 273/616頁 |
| 文件大?。?/td> | 15240K |
| 代理商： | MB90V560CR |
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328
CHAPTER 13 UART
r Transmission Control Circuit
The transmission control circuit consists of a transmission bit counter, transmission start circuit,
and transmission parity counter.The transmission bit counter counts transmission data bits.
When transmission of one data item of the specified data length is complete, the transmission
bit counter generates a transmission interrupt request. The transmission start circuit starts
transmission when send data is written to the output data register (SODR0/SODR1).
The
transmission parity counter generates the parity bits for data when transmitting data with parity.
r Reception Shift Register
The reception shift register fetches receive data input from the SIN0/1 pin, shifting the data bit
by bit. When reception is complete, the reception shift register transfers receive data to the
SIDR0/1 register.
r Transmission Shift Register
The transmission shift register transfers data written to the SODR0/1 register to itself and
outputs the data to the SOT0/1 pin, shifting the data bit by bit.
r Mode Control Register (SMR0/1)
The mode register performs the operations of the operation mode setting, baud rate clock
setting, serial clock I/O control, and output enable setting of serial data to pins.
r Control Register (SCR0/1)
The control register performs the operations of the parity presence/absence setting, parity
setting, stop bit length/data length settings, frame data format setting in operation mode 1,
clearing of received error flag bits, and enable/disable setting of send/receive operations.
r Status Register (SSR0/1)
The status register performs the operations of status check for transmission/reception and
errors, transfer direction setting of serial data, and enable/disable setting of send/receive
interrupt requests.
r Input Data Register (SIDR0/1)
This register retains receive data.
r Output Data Register (SODR0/1)
This register sets transmission data. Data written to this register is converted to serial data and
output.
相關PDF資料 |
PDF描述 |
|---|---|
| MB90V590ACR | 16-BIT, 16 MHz, MICROCONTROLLER, CPGA256 |
| MB91101APF | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP100 |
| MB91101PF-G-BND-R | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP100 |
| MB91103 | 32-BIT, 25 MHz, RISC MICROCONTROLLER, PQFP160 |
| MB91107PFV-G | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP120 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MB-910 | 制造商:Circuit Test 功能描述:BREADBOARD WIRING KIT - 350 PCS |
| MB9100100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB9100-100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB91101 | 制造商:Panasonic Industrial Company 功能描述:IC |
| MB91101A | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit RISC Microcontroller |
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