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參數(shù)資料
| 型號： | MB90V560CR |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 8 MHz, MICROCONTROLLER, CPGA256 |
| 封裝： | PGA-256 |
| 文件頁數(shù)： | 53/616頁 |
| 文件大?。?/td> | 15240K |
| 代理商： | MB90V560CR |
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130
CHAPTER 6 INTERRUPTS
6.4.1
Operation of Hardware Interrupts
This section explains hardware interrupt operation from generation of a interrupt
request to the completion of interrupt processing.
s Hardware Interrupt Activation
r Peripheral function (resource) operation (generation of an interrupt request)
A peripheral function (resource) that has a hardware interrupt request function has an "interrupt
request flag bit" and an "interrupt enable flag" in the corresponding peripheral function
(resource) control registers. The interrupt request flag bit indicates the presence of an interrupt
request. The interrupt enable flag determines whether a CPU interrupt request is enabled or
disabled. When an interrupt cause defined in a peripheral function is detected, an interrupt
request is output to an interrupt controller as long as the interrupt request flag bit is set to "1"
and the interrupt enable bit is set to enable an interrupt request to the CPU.
r Interrupt controller operation (interrupt request control)
The interrupt controller compares the interrupt level (IL) to set a request having the highest
level. If multiple interrupts of the same level are output simultaneously, an interrupt request with
the smallest number takes precedence (see Table 6.2-1 "Interrupt Vectors").
r CPU operation (interrupt request acceptance and interrupt processing)
The CPU compares the received interrupt level (ICR: IL2 to IL0) and the interrupt level mask
register (ILM). If IL2 to IL0 are greater than ILM and interrupts are enabled (PS: CCR: I = "1"),
the CPU terminates the instruction being executed and performs the interrupt processing. If the
EI2OS enable bit (ISE) of the interrupt control register (ICR) is set to "0", the CPU performs the
interrupt processing. If the ISE is set to "1", the CPU activates EI2OS.
Interrupt processing saves the contents of the dedicated registers (12 bytes including A, DPR,
ADB, DTB, PCB, PC, and PS) on the system stack (the system stack space indicated by the
SSB and SSP).
The CPU then loads data into the interrupt vector program counters (PCB and PC), updates the
ILM, and sets the stack flag (S) (sets CCR: S = 1 and activates the system stack).
s Returning from a Hardware Interrupt
If an interrupt processing program writes "0" to the interrupt request flag bit of a peripheral
function (resource) that output an interrupt cause and the RETI instruction is executed, data
saved on the system stack is restored to the dedicated registers and the program processing
that was executed before branching due to an interrupt is resumed.
相關PDF資料 |
PDF描述 |
|---|---|
| MB90V590ACR | 16-BIT, 16 MHz, MICROCONTROLLER, CPGA256 |
| MB91101APF | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP100 |
| MB91101PF-G-BND-R | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP100 |
| MB91103 | 32-BIT, 25 MHz, RISC MICROCONTROLLER, PQFP160 |
| MB91107PFV-G | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP120 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MB-910 | 制造商:Circuit Test 功能描述:BREADBOARD WIRING KIT - 350 PCS |
| MB9100100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB9100-100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB91101 | 制造商:Panasonic Industrial Company 功能描述:IC |
| MB91101A | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit RISC Microcontroller |
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