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參數(shù)資料
| 型號： | MC68HC08KH12A |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 121/178頁 |
| 文件大小： | 925K |
| 代理商： | MC68HC08KH12A |
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I/O Registers
MC68HC08KH12A Data Sheet, Rev. 1.1
Freescale Semiconductor
121
11.9.3 TIM Counter Modulo Registers (TMODH:TMODL)
The read/write TIM modulo registers contain the modulo value for the TIM counter. When the TIM counter
reaches the modulo value, the overflow flag (TOF) becomes set, and the TIM counter resumes counting
from $0000 at the next timer clock. Writing to the high byte (TMODH) inhibits the TOF bit and overflow
interrupts until the low byte (TMODL) is written. Reset sets the TIM counter modulo registers.
NOTE
Reset the TIM counter before writing to the TIM counter modulo registers.
11.9.4 TIM Channel Status and Control Registers (TSC0:TSC1)
Each of the TIM channel status and control registers does the following:
Flags input captures and output compares
Enables input capture and output compare interrupts
Selects input capture, output compare, or PWM operation
Selects high, low, or toggling output on output compare
Selects rising edge, falling edge, or any edge as the active input capture trigger
Selects output toggling on TIM overflow
Selects 0% and 100% PWM duty cycle
Selects buffered or unbuffered output compare/PWM operation
Address: $0014
TMODH
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Write:
Reset:
Bit15
Bit14
Bit13
Bit12
Bit11
Bit10
Bit9
Bit8
1
1
1
1
1
1
1
1
Address: $0015
TMODL
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Write:
Reset:
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
1
1
1
1
1
1
1
1
Figure 11-6. TIM Counter Modulo Registers (TMODH:TMODL)
Address: $0016
TSC0
Bit 7
CH0F
0
0
6
5
4
3
2
1
Bit 0
Read:
Write:
Reset:
CH0IE
MS0B
MS0A
ELS0B
ELS0A
TOV0
CH0MAX
0
0
0
0
0
0
0
Address: $0019
TSC1
Bit 7
CH1F
0
0
6
5
0
4
3
2
1
Bit 0
Read:
Write:
Reset:
CH1IE
MS1A
ELS1B
ELS1A
TOV1
CH1MAX
0
0
0
0
0
0
0
= Unimplemented
Figure 11-7. TIM Channel Status and Control Registers
(TSC0:TSC1)
相關(guān)PDF資料 |
PDF描述 |
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