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參數(shù)資料
| 型號(hào)： | MC68HC08KH12A |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 132/178頁 |
| 文件大?。?/td> | 925K |
| 代理商： | MC68HC08KH12A |
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Input/Output (I/O) Ports
MC68HC08KH12A Data Sheet, Rev. 1.1
132
Freescale Semiconductor
12.5.2 Data Direction Register D (DDRD)
Data direction register D determines whether each port D pin is an input or an output. Writing a logic one
to a DDRD bit enables the output buffer for the corresponding port D pin; a logic zero disables the output
buffer.
DDRD[7:0] — Data Direction Register D Bits
These read/write bits control port D data direction. Reset clears DDRD[7:0], configuring all port D pins
as inputs.
1 = Corresponding port D pin configured as output
0 = Corresponding port D pin configured as input
NOTE
Avoid glitches on port D pins by writing to the port D data register before
changing data direction register D bits from 0 to 1.
Figure 12-12
shows the port D I/O logic.
Figure 12-12. Port D I/O Circuit
When bit DDRDx is a logic one, reading address $0003 reads the PTDx data latch. When bit DDRDx is
a logic zero, reading address $0003 reads the voltage level on the pin. The data latch can always be
written, regardless of the state of its data direction bit.
Table 12-4
summarizes the operation of the port D
pins.
Table 12-4. Port D Pin Functions
Address: $0007
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Write:
Reset:
DDRD7
DDRD6
DDRD5
DDRD4
DDRD3
DDRD2
DDRD1
DDRD0
0
0
0
0
0
0
0
0
Figure 12-11. Data Direction Register D (DDRD)
DDRD Bit
PTD Bit
I/O Pin Mode
Accesses to DDRD
Read/Write
Accesses to PTD
Read
Write
0
X
(1)
1. X = don’t care
2. Hi-Z = high impedance
3. Writing affects data register, but does not affect input.
Input, Hi-Z
(2)
DDRD[7:0]
Pin
PTD[7:0]
(3)
1
X
Output
DDRD[7:0]
PTD[7:0]
PTD[7:0]
READ DDRD ($0007)
WRITE DDRD ($0007)
RESET
WRITE PTD ($0003)
READ PTD ($0003)
PTDx
DDRDx
PTDx
I
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