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參數(shù)資料
| 型號： | MC68HC08KH12A |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 71/178頁 |
| 文件大?。?/td> | 925K |
| 代理商： | MC68HC08KH12A |
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CGM Registers
MC68HC08KH12A Data Sheet, Rev. 1.1
Freescale Semiconductor
71
Figure 8-3
is a summary of the CGM registers.
8.5.1 PLL Control Register (PCTL)
The PLL control register contains the interrupt enable and flag bits, the on/off switch, the base clock
selector bit, the prescaler bits, and the VCO power of two range selector bits.
Addr.
Register Name
Bit 7
6
5
4
3
2
1
Bit 0
$003A
PLL Control Register
(PCTL)
Read:
PLLIE
PLLF
PLLON
BCS
PRE1
PRE2
0
0
Write:
Reset:
0
0
1
0
1
0
0
0
$003B
PLL Bandwidth Control Regis-
ter
(PBWC)
Read:
AUTO
LOCK
ACQ
0
0
0
0
0
Write:
Reset:
0
0
0
0
0
0
0
0
$003C
PLL Multiplier Select Register
High
(PMSH)
Read:
0
0
0
0
MUL11
MUL10
MUL9
MUL8
Write:
Reset:
0
0
0
0
0
0
0
0
$003D
PLL Multiplier Select Register
Low
(PMSL)
Read:
MUL7
MUL6
MUL5
MUL4
MUL3
MUL2
MUL1
MUL0
Write:
Reset:
0
0
0
0
0
0
1
0
$003E
Unimplemented
Read:
Write:
Reset:
$003F
PLL Reference Divider Select
Register
(PRDS)
Read:
0
0
0
0
RDS3
RDS2
RDS1
RDS0
Write:
Reset:
0
0
0
0
0
0
0
1
= Unimplemented
NOTES:
1. When AUTO = 0, PLLIE is forced clear and is read-only.
2. When AUTO = 0, PLLF and LOCK read as clear.
3. When AUTO = 1, ACQ is read-only.
4. When PLLON = 0 or VRS7:VRS0 = $0, BCS is forced clear and is read-only.
5. When PLLON = 1, the PLL programming register is read-only.
6. When BCS = 1, PLLON is forced set and is read-only.
Figure 8-3. CGM I/O Register Summary
Address:
$003A
Bit 7
6
5
4
3
2
1
Bit 0
Read:
PLLIE
PLLF
PLLON
BCS
PRE1
PRE2
0
0
Write:
Reset:
0
0
1
0
1
0
0
0
= Unimplemented
Figure 8-4. PLL Control Register (PCTL)
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