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參數(shù)資料
| 型號： | MC68HC08KH12A |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 126/178頁 |
| 文件大?。?/td> | 925K |
| 代理商： | MC68HC08KH12A |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁當(dāng)前第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁
Input/Output (I/O) Ports
MC68HC08KH12A Data Sheet, Rev. 1.1
126
Freescale Semiconductor
12.2 Port A
Port A is an 8-bit general-purpose bidirectional I/O port with software configurable pullups.
12.2.1 Port A Data Register (PTA)
The port A data register contains a data latch for each of the eight port A pins.
PTA[7:0] — Port A Data Bits
These read/write bits are software programmable. Data direction of each port A pin is under the control
of the corresponding bit in data direction register A. Reset has no effect on port A data.
The port A pullup enable bit, PAP, in the port option control register (POC) enables pullups on port A pins
if the respective pin is configured as an input. (See
12.8 Port Options
.)
$0008
Port E Data Register
(PTE)
Read:
0
0
0
PTE4
PTE3
PTE2
PTE1
PTE0
Write:
Reset:
Unaffected by reset
$0009
Port F Data Register
(PTF)
Read:
PTF7
PTF6
PTF5
PTF4
PTF3
PTF2
PTF1
PTF0
Write:
Reset:
Unaffected by reset
$000A
Data Direction Register E
(DDRE)
Read:
0
0
0
DDRE4
DDRE3
DDRE2
DDRE1
DDRE0
Write:
Reset:
0
0
0
0
0
0
0
0
$000B
Data Direction Register F
(DDRF)
Read:
DDRF7
DDRF6
DDRF5
DDRF4
DDRF3
DDRF2
DDRF1
DDRF0
Write:
Reset:
0
0
0
0
0
0
0
0
$001C
Port E Optical Interface
Enable Register
(EOIER)
Read:
YREF2
YREF1
YREF0
XREF2
XREF1
XREF0
OIEY
OIEX
Write:
Reset:
0
1
0
0
1
0
0
0
$001D
Port Option Control Register
(POC)
Read:
0
0
LDD
0
0
PCP
PBP
PAP
Write:
Reset:
0
0
1
0
0
0
0
0
Address: $0000
Bit 7
6
5
4
3
2
1
Bit 0
Read:
PTA7
PTA6
PTA5
PTA4
PTA3
PTA2
PTA1
PTA0
Write:
Reset:
Unaffected by reset
Figure 12-1. Port A Data Register (PTA)
Addr.
Register Name
Bit 7
6
5
4
3
2
1
Bit 0
= Unimplemented
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC08LT8 | Microcontrollers |
| MC68HC08SR12 | M68HC08 Microcontrollers |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MC68HC08LJ12CFB | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Addendum to MC68HC908LJ12 Technical Data |
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