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參數(shù)資料
| 型號： | MC68HC08KH12A |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 70/178頁 |
| 文件大?。?/td> | 925K |
| 代理商： | MC68HC08KH12A |
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Clock Generator Module (CGM)
MC68HC08KH12A Data Sheet, Rev. 1.1
70
Freescale Semiconductor
8.4.5 PLL Analog Ground Pin (V
SSA
)
V
SSA
is a ground pin used by the analog portions of the PLL. Connect the V
SSA
pin to the same voltage
potential as the V
SS
pin.
NOTE
Route V
SSA
carefully for maximum noise immunity and place bypass
capacitors as close as possible to the package.
8.4.6 Buffered Crystal Clock Output (CGMVOUT)
CGMVOUT buffers the OSC1 clock for external use.
8.4.7 CGMVSEL
CGMVSEL must be tied low or floated.
8.4.8 Oscillator Enable Signal (SIMOSCEN)
The SIMOSCEN signal comes from the system integration module (SIM) and enables the oscillator and
PLL.
8.4.9 Crystal Output Frequency Signal (CGMXCLK)
CGMXCLK is the crystal oscillator output signal. It runs at the full speed of the crystal (f
XCLK
) and comes
directly from the crystal oscillator circuit.
Figure 8-2
shows only the logical relation of CGMXCLK to OSC1
and OSC2 and may not represent the actual circuitry. The duty cycle of CGMXCLK is unknown and may
depend on the crystal and other external factors. Also, the frequency and amplitude of CGMXCLK can be
unstable at startup.
8.4.10 CGM Base Clock Output (CGMOUT)
CGMOUT is the clock output of the CGM. This signal goes to the SIM, which generates the MCU clocks.
CGMOUT is a 50 percent duty cycle clock running at twice the bus frequency. CGMOUT is software
programmable to be either the oscillator output, CGMXCLK, divided by two or the VCO clock, CGMVCLK,
divided by two.
8.4.11 CGM CPU Interrupt (CGMINT)
CGMINT is the interrupt signal generated by the PLL lock detector.
8.5 CGM Registers
These registers control and monitor operation of the CGM:
PLL control register (PCTL) (See
8.5.1 PLL Control Register (PCTL)
.)
PLL bandwidth control register (PBWC) (See
8.5.2 PLL Bandwidth Control Register (PBWC)
.)
PLL multiplier select registers (PMSH:PMSL) (See
8.5.3 PLL Multiplier Select Registers
(PMSH:PMSL)
.)
PLL reference divider select register (PRDS) (See
8.5.4 PLL Reference Divider Select Register
(PRDS)
.)
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PDF描述 |
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