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參數(shù)資料
| 型號： | MFRC50001T |
| 廠商： | NXP Semiconductors N.V. |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Highly integrated ISO-IEC 14443 A reader IC |
| 封裝： | MFRC50001T/0FE<SOT287-1 (SO32)|<<http://www.nxp.com/packages/SOT287-1.html<1<week 15, 2005,; |
| 文件頁數(shù)： | 107/110頁 |
| 文件大小： | 841K |
| 代理商： | MFRC50001T |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁當(dāng)前第107頁第108頁第109頁第110頁
MFRC500_33
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NXP B.V. 2010. All rights reserved.
Product data sheet
PUBLIC
Rev. 3.3 — 15 March 2010
048033
107 of 110
NXP Semiconductors
MFRC500
Highly Integrated ISO/IEC 14443 A Reader IC
23. Figures
Fig 1.
Fig 2.
Fig 3.
MFRC500 block diagram. . . . . . . . . . . . . . . . . . . .4
MFRC500 pin configuration. . . . . . . . . . . . . . . . . .5
Connection to microprocessor: separate
read and write strobes . . . . . . . . . . . . . . . . . . . . . .8
Connection to microprocessor: common
read and write strobes . . . . . . . . . . . . . . . . . . . . . .9
Connection to microprocessor: EPP common
read/write strobes and handshake. . . . . . . . . . . . .9
Key storage format . . . . . . . . . . . . . . . . . . . . . . .14
Timer module block diagram . . . . . . . . . . . . . . . .20
The StartUp procedure. . . . . . . . . . . . . . . . . . . . .25
Quartz clock connection . . . . . . . . . . . . . . . . . . .26
Fig 10. Receiver circuit block diagram. . . . . . . . . . . . . . .30
Fig 11. Automatic Q-clock calibration . . . . . . . . . . . . . . .31
Fig 12. Serial signal switch block diagram. . . . . . . . . . . .33
Fig 13. Crypto1 key handling block diagram . . . . . . . . . .36
Fig 14. Transmitting bit oriented frames . . . . . . . . . . . . .70
Fig 15. Timing for transmitting byte oriented frames . . . .71
Fig 16. Timing for transmitting bit oriented frames. . . . . .71
Fig 17. Card communication state diagram. . . . . . . . . . .76
Fig 18. EEPROM programming timing diagram. . . . . . . .78
Fig 19. Separate read/write strobe timing diagram . . . . .87
Fig 20. Common read/write strobe timing diagram . . . . .88
Fig 21. Timing diagram for common read/write strobe;
EPP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .89
Fig 22. Application example circuit diagram: directly
matched antenna. . . . . . . . . . . . . . . . . . . . . . . . .91
Fig 23. TX control signals . . . . . . . . . . . . . . . . . . . . . . . .95
Fig 24. RX control signals . . . . . . . . . . . . . . . . . . . . . . . .96
Fig 25. ISO/IEC 14443 A receiving path Q-clock. . . . . . .98
Fig 26. Package outline SOT287-1 . . . . . . . . . . . . . . . . .99
Fig 4.
Fig 5.
Fig 6.
Fig 7.
Fig 8.
Fig 9.
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PDF描述 |
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