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參數(shù)資料
| 型號(hào)： | MFRC50001T |
| 廠商： | NXP Semiconductors N.V. |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Highly integrated ISO-IEC 14443 A reader IC |
| 封裝： | MFRC50001T/0FE<SOT287-1 (SO32)|<<http://www.nxp.com/packages/SOT287-1.html<1<week 15, 2005,; |
| 文件頁(yè)數(shù)： | 63/110頁(yè) |
| 文件大?。?/td> | 841K |
| 代理商： | MFRC50001T |
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MFRC500_33
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NXP B.V. 2010. All rights reserved.
Product data sheet
PUBLIC
Rev. 3.3 — 15 March 2010
048033
63 of 110
NXP Semiconductors
MFRC500
Highly Integrated ISO/IEC 14443 A Reader IC
10.5.6.6
IRQPinConfig register
Configures the output stage for pin IRQ.
Table 113. IRQPinConfig register (address: 2Dh) reset value: 0000 0010b, 02h bit allocation
Bit
7
6
5
4
Symbol
000000
Access
R/W
Table 114. IRQPinConfig register bit descriptions
Bit
Symbol
7 to 2
000000
1
IRQInv
10.5.6.7
PreSet2E register
Table 115. PreSet2E register (address: 2Eh) reset value: xxxx xxxxb, xxh bit allocation
Bit
7
6
5
Symbol
Access
10.5.6.8
PreSet2F register
Table 116. PreSet2F register (address: 2Fh) reset value: xxxx xxxxb, xxh bit allocation
Bit
7
6
5
Symbol
Access
10.5.7
Page 6: reserved
10.5.7.1
Page register
Selects the page register; see
Section 10.5.1.1 “Page register” on page 43
.
10.5.7.2
Reserved registers 31h, 32h, 33h, 34h, 35h, 36h and 37h
Table 117. Reserved registers (address: 31h, 32h, 33h, 34h, 35h, 36h, 37h)
reset value: xxxx xxxxb, xxh bit allocation
Bit
7
6
5
Symbol
Access
Remark:
These registers are reserved for future use.
3
2
1
0
IRQInv
R/W
IRQPushPull
R/W
Value
0
1
0
1
0
Description
these values must not be changed
inverts the signal on pin IRQ with respect to bit IRq
the signal on pin IRQ is not inverted and is the same as bit IRq
pin IRQ functions as a standard CMOS output pad
pin IRQ functions as an open-drain output pad
0
IRQPushPull
4
3
2
1
0
xxxxxxxx
W
4
3
2
1
0
xxxxxxxx
W
4
3
2
1
0
xxxxxxxx
W
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MFRC53001T | ISO-IEC 14443 A Reader IC |
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參數(shù)描述 |
|---|---|
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