參數(shù)資料
型號(hào)： TSB12LV32-EP
英文描述： IC APEX 20KE FPGA 100K 324-FBGA
中文描述： 軍事增強(qiáng)塑料電機(jī)及電子學(xué)工程師聯(lián)合會(huì)1394-1995和P1394a兼容通用鏈路層控制器
文件頁數(shù)： 7/106頁
文件大?。?/td> 605K
代理商： TSB12LV32-EP
vii
5
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22 Asynchronous Block Transmit With Automatic Header Insertion at 400 Mbps
5
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23 Asynchronous Quadlet Transmit Without Automatic Header Insertion
at 400 Mbps
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5
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24 Asynchronous Block Transmit Without Automatic Header Insertion
at 400 Mbps
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5
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25 Asynchronous Quadlet Receive With Headers and Trailer at 400 Mbps
5
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26 Asynchronous Block Receive With Headers and Trailer at 400 Mbps
5
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27 Asynchronous Quadlet Receive Without Headers and Trailer at 400 Mbps
5
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28 Asynchronous Block Receive Without Headers and Trailer at 400 Mbps
5
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29 Endian Swapping in Byte Mode
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5
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30 Endian Swapping in Word Mode
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5
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31 Data Mover Handshake Mode (GPLynx mode)
5
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32 Clock to Output Timing With Respect to DMCLK
6
–
1 TSB12LV32 Controller-FIFO-Access Address Map
6
–
2 Asynchronous Packet With N Quadlets (ATV Loading Operation)
7
–
1 Quadlet-Transmit Format (Write Request)
7
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2 Quadlet-Transmit Format (Read Response)
7
–
3 Block-Transmit Format
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7
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4 FIFO Quadlet-Receive Format
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
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5 Data Mover Quadlet-Receive Format
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
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6 FIFO Block-Receive Format
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
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7 Data Mover Block-Receive Format
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7
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8 Isochronous-Transmit Format
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7
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9 Data Mover Isochronous-Receive Format
7
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10 GRF Isochronous-Receive Format
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7
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11 Phy Configuration Packet Format
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
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12 Received Phy Configuration Packet Format
7
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13 Ping Packet Format
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
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14 Remote Access Packet Format
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
–
15 Remote Command Packet Format
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
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16 Resume Packet Format
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
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17 Receive Self-ID Packet Format (RXSID=1, FULLSID=1)
7
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18 Receive Self-ID Packet Format (RXSID=1, FULLSID=0)
7
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19 Phy Self-ID Packet #0 Format
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
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20 Phy Self-ID Packet #1 Format
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7
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21 Phy Self-ID Packet #2 Format
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8
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1 Phy-LLC Interface
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8
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2 LREQ Request Stream
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8
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3 Status Transfer Timing
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4 Normal Packet Reception Timing
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8
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5 Null Packet Reception Timing
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8
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6 Normal Packet Transmission Timing
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8
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7 Critical Timing for the TSB12LV32/Phy Interface
5
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15
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6
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相關(guān)PDF資料
PDF描述
TSB12LV01B-EP FPGA (Field-Programmable Gate Array)
TSB12LV01BPZ FPGA (Field-Programmable Gate Array)
TSB12LV26-EP 672-pin FineLine BGA
TSB12LV22PZP OHCI-Lynx PCI-BASED IEEE 1394 HOST CONTROLLER
TSB12LV26PZ OHCI-Lynx PCI-BASED IEEE 1394 HOST CONTROLLER
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TSB12LV32I 制造商:TI 制造商全稱:Texas Instruments 功能描述:IEEE 1394-1995 and P1394a Compliant General-Purpose Link-Layer Controller
TSB12LV32IPZ 功能描述:1394 接口集成電路 General-Purpose Link Layer Cntrlr RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray
TSB12LV32IPZEP 制造商:Texas Instruments 功能描述:1394 I-TEMP 1394 GENERAL-PURPOSE LINK LAYER CONTROLLER (GP2L - Rail/Tube
TSB12LV32IPZG4 功能描述:1394 接口集成電路 General Purpose Link Layer Cntrlr RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray
TSB12LV32PZ 功能描述:1394 接口集成電路 General-Purpose Link Layer Cntrlr RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray
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