參數(shù)資料
型號： μPDPD30101
廠商： NEC Corp.
英文描述： 64-Bit Micro[rocessor(64位微處理器)
中文描述： 64位微[rocessor（64位微處理器）
文件頁數(shù)： 17/97頁
文件大小： 409K
代理商： ΜPDPD30101
μ
PD30101
16
3. INTERNAL ARCHITECTURE
3.1 Pipeline
Each instruction is executed in the following five steps:
(1) IF
(2) RF
(3) EX
(4) DC
(5) WB
Instruction fetch
Register fetch
Execution
Data cache fetch
Write back
The V
R
4101 has a five-stage pipeline. It takes five clocks to execute each instruction, but instructions can be executed
in parallel. The pipeline clock, PClock, operates at a frequency of 33 MHz.
The following figure outlines the pipeline.
Figure 3-1. Pipeline of V
R
4101 (5-stage)
PClock
IF
RF
EX
DC
WB
IF
RF
EX
DC
WB
IF
RF
EX
DC
WB
IF
RF
EX
DC
WB
IF
RF
EX
DC
WB
Current
CPU
cycle
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