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參數(shù)資料
| 型號： | μPDPD30101 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-Bit Micro[rocessor(64位微處理器) |
| 中文描述： | 64位微[rocessor（64位微處理器） |
| 文件頁數(shù)： | 85/97頁 |
| 文件大?。?/td> | 409K |
| 代理商： | ΜPDPD30101 |
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μ
PD30101
84
(12)System bus parameter (ZWS) (1/2)
Parameter
Symbol
Condition
MIN.
MAX.
Unit
Address (ADD (0:20)) setup time (vs. PCMCLK
↓
)
Address (ADD (0:20)) setup time (vs. command signal
↓
)
Note 1, 2
Address hold time (vs. command signal
↑
)
Note 1
Command signal setup time (vs. PCMCLK
↑
)
Note 1
Command signal recovery time
Note 1
t
AVCK
15
ns
t
AVCL
60N – 28
ns
t
CHAV
25
ns
t
CLCK
15
ns
t
CHCL
100
ns
Data output setup time (vs. command signal
↓
)
Note 1
Data output hold time (vs. command signal
↑
)
Note 1
Data input setup time (vs. command signal
↑
)
Note 1
Data input hold time (vs. command signal
↑
)
Note 1
Command signal low-level width
Note 1, 2
t
DVCL
0
ns
t
CHDV
25
ns
t
DS
20
ns
t
DH
15
ns
t
CLCH
60N – 28
ns
ZWS delay time (vs. command signal
↓
)
Note 1, 2
ZWS hold time (vs. command signal
↑
)
Note 1
Notes 1.
With the V
R
4101, the MEMW, MEMR, IOW, and IOR pins are called the command signals for the
system bus interface.
2.
Set the value of N by using the WISA (0:2) bits of the BCUSPEEDREG register.
t
CLZL
60N – 111
ns
t
CHZH
0
ns
WISA2
WISA1
WISA0
N
0
0
0
8
0
0
1
7
0
1
0
6
0
1
1
5
1
0
0
4
1
0
1
3
1
1
0
—
1
1
1
—
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