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參數(shù)資料
| 型號： | μPDPD30101 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-Bit Micro[rocessor(64位微處理器) |
| 中文描述： | 64位微[rocessor（64位微處理器） |
| 文件頁數(shù)： | 42/97頁 |
| 文件大小： | 409K |
| 代理商： | ΜPDPD30101 |
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μ
PD30101
41
6. DMAAU (DMA ADDRESS UNIT)
6.1 General
The DMAAU controls the addresses for the DMA operations of PIU, SIU (transmission/reception), AIU, and KIU.
The DMA start physical address of each peripheral unit can be specified in a range of 0x0000 0000 to 0x001 FFFE as
a half-word address. The DMA space of each peripheral unit is a 2K-block including the DMA start address, and is
aligned at a 2K-byte boundary. The DMA operation is not guaranteed if the DMA space overlaps with that of other
peripheral unit.
Table 6-1. DMAAU Registers
Symbol
Function
PADDMAADRLREG
DMA channel low-order address register for touch panel
PADDMAADRHREG
DMA channel high-order address register for touch panel
SRXDMAADRLREG
DMA channel low-order address register for SIU reception
SRXDMAADRHREG
DMA channel high-order address register for SIU reception
STXDMAADRLREG
DMA channel low-order address register for SIU transmission
STXDMAADRHREG
DMA channel high-order address register for SIU transmission
AUDDMAADRLREG
DMA channel low-order address register for audio output
AUDDMAADRHREG
DMA channel high-order address register for audio output
KEYDMAADRLREG
DMA channel low-order address register for keyboard input
KEYDMAADRHREG
DMA channel high-order address register for keyboard input
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