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參數(shù)資料
| 型號： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 106/609頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標準包裝： | 126 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應商設備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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XRT79L71
PRELIMINARY
179
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
The purpose of the Receive DS3/E3 LIU Block is to accept an DS3/E3 line signal and to perform all of the
following operations on this data.
To be able to receive a distorted DSX-3 signal, that has been attenuated by at least 450 feet of cable loss,
along with an additional 6dB of flat or resistive loss in an error-free manner.
To perform Clock and Data Recovery on this incoming DS3 line signal.
To declare and clear the LOS (Loss of Signal) defect condition
To declare and clear the LOL (Loss of Lock) defect condition
To decode this incoming DS3 line signal from the B3ZS line code, back into a binary data-stream, prior to
routing this signal to the Receive DS3/E3 Framer block.
To be able to comply with the Category I and II Jitter Tolerance Requirements per Bellcore GR-499-CORE
This particular section will describe the functionality and configuration options of the Receive DS3/E3 LIU
Block for DS3 applications. The functionality and configuration options of the Receive DS3/E3 LIU Block for
E3 applications will be discussed in Section 5.3.1.
Figure 83 presents a more detailed illustration of the Receive DS3/E3 LIU Block within the XRT79L71.
FIGURE 82. ILLUSTRATION OF THE FUNCTIONAL BLOCK DIAGRAM OF THE RECEIVE DIRECTION CIRCUITRY, WHEN-
EVER THE
XRT79L71 HAS BEEN CONFIGURED TO OPERATE IN THE DS3 CLEAR-CHANNEL FRAMER MODE (WITH THE
RECEIVE DS3 LIU BLOCK HIGHLIGHTED)
Receive
Payload Data
Output
Interface
Block
Receive
Payload Data
Output
Interface
Block
Receive
DS3/E3
Framer
Block
Receive
DS3/E3
Framer
Block
Receive
DS3/E3
LIU Block
Receive
DS3/E3
LIU Block
RxSer
RxNib[3:0]
RxClk
RRING
RTIP
Receive
Overhead Data
Output Interface
Block
Receive
Overhead Data
Output Interface
Block
RxOHClk
RxOHInd
RxOH
RxOHEnable
RxOHFrame
RxNibClk
RxFrame
Rx LAPD
Controller
Block
Rx LAPD
Controller
Block
From Microprocessor
Interface Block
Rx LAPD
Buffer
(90 Bytes)
Rx LAPD
Buffer
(90 Bytes)
Rx FEAC
Processor
Block
Rx FEAC
Processor
Block
相關PDF資料 |
PDF描述 |
|---|---|
| XRT81L27IV-F | IC LIU EI 7CH 3.3V 128TQFP |
| XRT82D20IW-F | IC LIU E1 SGL 28SOJ |
| XRT82L24AIV-F | IC LIU E1 QAUD 100TQFP |
| XRT83D10IW | IC LIU T1/E1 SGL 28SOJ |
| XRT83L30IV-F | IC LIU LH/SH T1/E1 SGL 64TQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT79L72IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73 | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L74 | 制造商:EXAR 制造商全稱:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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