參數(shù)資料
型號： EP2C20F256I6N
廠商： ALTERA CORP
元件分類： FPGA
英文描述： FPGA, 1196 CLBS, PBGA256
封裝： LEAD FREE, FBGA-256
文件頁數(shù)： 4/168頁
文件大?。?/td> 2206K
代理商： EP2C20F256I6N
Altera Corporation
5–11
February 2008
Cyclone II Device Handbook, Volume 1
DC Characteristics and Timing Specifications
DC
Characteristics
for Different Pin
Types
Table 5–10 shows the types of pins that support bus hold circuitry.
Differential 1.8-V
HSTL class I
and II (3)
———
—
VCCIO
– 0.4
——
0.4
Differential
SSTL-2 class I
———
—
VTT +
0.57
——
VTT –
0.57
Differential
SSTL-2 class II
———
—
VTT +
0.76
——
VTT –
0.76
Differential
SSTL-18 class I
—
0.5 ×
VCCIO
–
0.125
0.5 ×
VCCIO
0.5 ×
VCCIO
+
0.125
VTT +
0.475
——
VTT –
0.475
Differential
SSTL-18 class II
—
0.5 ×
VCCIO
–
0.125
0.5 ×
VCCIO
0.5 ×
VCCIO
+
0.125
VCCIO
– 0.28
—
0.28
Notes to Table 5–9:
(1)
The LVPECL I/O standard is only supported on clock input pins. This I/O standard is not supported on output
pins.
(2)
The RSDS and mini-LVDS I/O standards are only supported on output pins.
(3)
The differential 1.8-V HSTL and differential 1.5-V HSTL I/O standards are only supported on clock input pins and
PLL output clock pins.
(4)
The differential SSTL-18 and SSTL-2 I/O standards are only supported on clock input pins and PLL output clock
pins.
Table 5–9. DC Characteristics for User I/O Pins Using Differential I/O Standards Note (1) (Part 2 of 2)
I/O Standard
VOD (mV)
ΔVOD (mV)
VOCM (V)
VOH (V)
VOL (V)
Min
Typ
Max
Min Max
Min
Typ
Max
Min
Max
Min
Max
Table 5–10. Bus Hold Support
Pin Type
Bus Hold
I/O pins using single-ended I/O standards
Yes
I/O pins using differential I/O standards
No
Dedicated clock pins
No
JTAG
No
Configuration pins
No
相關(guān)PDF資料
PDF描述
EP2SGX60CF780C3N FPGA, 60440 CLBS, 717 MHz, PBGA780
EP2SGX60CF780C3 FPGA, 60440 CLBS, 717 MHz, PBGA780
EP2SGX60CF780C4N FPGA, 60440 CLBS, 717 MHz, PBGA780
EP2SGX60CF780C4 FPGA, 60440 CLBS, 717 MHz, PBGA780
EP2SGX60CF780C5N FPGA, 60440 CLBS, 640 MHz, PBGA780
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
EP2C20F256I8 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone II 1172 LABs 152 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2C20F256I8GA 制造商:Altera Corporation 功能描述:
EP2C20F256I8N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone II 1172 LABs 152 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2C20F484C6 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone II 1172 LABs 315 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2C20F484C6N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone II 1172 LABs 315 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。

采購需求

(若只采購一條型號，填寫一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

*型號 *數(shù)量 廠商 批號 封裝
添加更多采購

我的聯(lián)系方式

*
*
*