參數(shù)資料
型號： EP2C20F256I6N
廠商： ALTERA CORP
元件分類： FPGA
英文描述： FPGA, 1196 CLBS, PBGA256
封裝： LEAD FREE, FBGA-256
文件頁數(shù)： 47/168頁
文件大?。?/td> 2206K
代理商： EP2C20F256I6N
5–50
Altera Corporation
Cyclone II Device Handbook, Volume 1
February 2008
Timing Specifications
SSTL_18_ CLASS_II
16 mA
260
220
180
—
————
18 mA
270
220
180
——
————
1.8V_HSTL_ CLASS_I
8 mA
260
220
180
260
220
180
260
220
180
10 mA
300
250
210
300
250
210
300
250
210
12 mA
320
270
220
320
270
220
320
270
220
1.8V_HSTL_ CLASS_II 16 mA
230
190
160
—
————
18 mA
240
200
160
——
————
20 mA
250
210
170
——
————
1.5V_HSTL_ CLASS_I
8 mA
210
170
140
210
170
140
210
170
140
10 mA
220
180
150
——
————
12 mA
230
190
160
——
————
1.5V_HSTL_ CLASS_II 16 mA
210
170
140
—
————
DIFFERENTIAL_
SSTL_2_CLASS_I
8 mA
400
340
280
400
340
280
400
340
280
12 mA
400
340
280
400
340
280
400
340
280
DIFFERENTIAL_
SSTL_2_CLASS_II
16 mA
350
290
240
350
290
240
350
290
240
20 mA
400
340
280
——
————
24 mA
400
340
280
——
————
DIFFERENTIAL_
SSTL_18_CLASS_I
6 mA
260
220
180
260
220
180
260
220
180
8 mA
260
220
180
260
220
180
260
220
180
10 mA
270
220
180
270
220
180
270
220
180
12 mA
280
230
190
——
————
DIFFERENTIAL_SSTL
_18_CLASS_II
16 mA
260
220
180
——
————
18 mA
270
220
180
——
————
1.8V_
DIFFERENTIAL_HSTL
_CLASS_I
8 mA
260
220
180
260
220
180
260
220
180
10 mA
300
250
210
300
250
210
300
250
210
12 mA
320
270
220
320
270
220
320
270
220
1.8V_
DIFFERENTIAL_HSTL
_CLASS_II
16 mA
230
190
160
——
————
18 mA
240
200
160
——
————
20 mA
250
210
170
——
————
Table 5–45. Maximum Output Clock Toggle Rate on Cyclone II Devices (Part 3 of 4)
I/O Standard
Drive
Strength
Maximum Output Clock Toggle Rate on Cyclone II Devices (MHz)
Column I/O Pins (1)
Row I/O Pins (1)
Dedicated Clock
Outputs
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
相關(guān)PDF資料
PDF描述
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EP2SGX60CF780C4N FPGA, 60440 CLBS, 717 MHz, PBGA780
EP2SGX60CF780C4 FPGA, 60440 CLBS, 717 MHz, PBGA780
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